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參數資料
| 型號： | HC908AT32GRS |
| 英文描述： | 68HC908AT32 General Release Specification |
| 中文描述： | 68HC908AT32一般版本規(guī)范 |
| 文件頁數： | 145/586頁 |
| 文件大小： | 3136K |
| 代理商： | HC908AT32GRS |
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Clock Generator Module (CGM)
Functional Description
MC68HC908AT32
—
Rev. 2.0
General Release Specification
MOTOROLA
Clock Generator Module (CGM)
For More Information On This Product,
Go to: www.freescale.com
145
L
G
R
then slightly alters the dc voltage on the external capacitor connected to
CGMXFC based on the width and direction of the correction pulse. The
filter can make fast or slow corrections depending on its mode,
described in
8.4.2.2 Acquisition and Tracking Modes
. The value of the
external capacitor and the reference frequency determines the speed of
the corrections and the stability of the PLL.
The lock detector compares the frequencies of the VCO feedback clock,
CGMVDV, and the final reference clock, CGMRDV. Therefore, the
speed of the lock detector is directly proportional to the final reference
frequency, f
RDV
. The circuit determines the mode of the PLL and the lock
condition based on this comparison.
8.4.2.2 Acquisition and Tracking Modes
The PLL filter is manually or automatically configurable into one of two
operating modes:
Acquisition mode — In acquisition mode, the filter can make large
frequency corrections to the VCO. This mode is used at PLL
startup or when the PLL has suffered a severe noise hit and the
VCO frequency is far off the desired frequency. When in
acquisition mode, the ACQ bit is clear in the PLL bandwidth
control register. (See
8.6.2 PLL Bandwidth Control Register
.)
Tracking mode — In tracking mode, the filter makes only small
corrections to the frequency of the VCO. PLL jitter is much lower
in tracking mode, but the response to noise is also slower. The
PLL enters tracking mode when the VCO frequency is nearly
correct, such as when the PLL is selected as the base clock
source. (See
8.4.3 Base Clock Selector Circuit
.) The PLL is
automatically in tracking mode when it’s not in acquisition mode or
when the ACQ bit is set.
8.4.2.3 Manual and Automatic PLL Bandwidth Modes
The PLL can change the bandwidth or operational mode of the loop filter
manually or automatically.
F
Freescale Semiconductor, Inc.
n
.
相關PDF資料 |
PDF描述 |
|---|---|
| HC908JB16AD | Addendum to MC68HC908JB16 Technical Data Rev. 1.0 |
| HC908JB8AD | Addendum to MC68HC908JB8 Technical Data Rev. 2.0 |
| HC908JL3AD | Addendum to MC68HC908JL3 Technical Data Rev. 1.0 |
| HC908JL8AD | Addendum to MC68HC908JL8 Technical Data Rev. 2.0 |
| HC908LD64AD | Addendum to MC68HC908LD64 Technical Data Rev. 2.0 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| HC908JB16AD | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Addendum to MC68HC908JB16 Technical Data |
| HC908JB16D | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Addendum to MC68HC908JB16 Technical Data |
| HC908JB8AD | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Addendum to MC68HC908JB8 Technical Data Rev. 2.0 |
| HC908JL3AD | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Addendum to MC68HC908JL3 Technical Data Rev. 1.0 |
| HC908JL8AD | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Addendum to MC68HC908JL8 Technical Data Rev. 2.0 |
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