- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄370468 > HD6433436TF16 (Hitachi,Ltd.) 12 V must not be applied to the S-mask model (single-power-supply specification), as this may permanently damage the device. PDF資料下載
參數(shù)資料
| 型號： | HD6433436TF16 |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | 12 V must not be applied to the S-mask model (single-power-supply specification), as this may permanently damage the device. |
| 中文描述： | 12伏不能適用的S -面具模型（單電源規(guī)范），因為這可能會永久損壞設(shè)備。 |
| 文件頁數(shù)： | 340/752頁 |
| 文件大?。?/td> | 2656K |
| 代理商： | HD6433436TF16 |
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311
13.4
Application Notes
In master mode, if an instruction to generate a start condition is immediately followed by an
instruction to generate a stop condition, neither condition will be output correctly. To output
consecutive start and stop conditions, after issuing the instruction that generates the start
condition, read the relevant ports, check that SCL and SDA are both low, then issue the
instruction that generates the stop condition.
Either of the following two conditions will start the next transfer. Pay attention to these
conditions when reading or writing to ICDR.
Write access to ICDR when ICE = 1 and TRS = 1
Read access to ICDR when ICE = 1 and TRS = 0
The I
2
C bus interface specification for the SCL rise time tsr is under 1000 ns (300 ns for high-
speed mode). In master mode, the I
2
C bus interface monitors the SCL line and synchronizes
one bit at a time during communication. If tsr (the time for SCL to go from low to V
IH
) exceeds
the time determined by the input clock of the I
2
C bus interface, the high period of SCL is
extended. SCL rise time is determined by the pull-up resistance and load capacitance of the
SCL line. To insure proper operation at the set transfer rate, adjust the pull-up resistance and
load capacitance so that the SCL rise time falls below the values given in the table below.
t
cyc
Display
Time Display
CKDBL
IICX
= 5 MHz
= 8 MHz
= 10 MHz
= 16 MHz
0
0
7.5t
cyc
Normal
mode
1000 ns
937 ns
750 ns
486 ns
High-speed
mode
300 ns
300 ns
300 ns
300 ns
0
1
17.5t
cyc
Normal
mode
1000 ns
1000 ns
1000 ns
1000 ns
1
0
High-speed
mode
300 ns
300 ns
300 ns
300 ns
1
1
37.5t
cyc
Normal
mode
1000 ns
1000 ns
1000 ns
1000 ns
High-speed
mode
300 ns
300 ns
300 ns
300 ns
Note on Issuance of Retransmission Start Condition
When issuing a retransmission start condition, the condition must be issued after the SCL clock
falls during the acknowledge bit reception period. After the end of the acknowledge bit, the
next data should be written to ICDR after SCL goes high. Figure 13.16 shows the
recommended program flow for issuing a retransmission start condition. A timing chart for the
flowchart in figure 13.16 is shown in figure 13.17.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| HD64F3437FLH16 | 12 V must not be applied to the S-mask model (single-power-supply specification), as this may permanently damage the device. |
| HD6433801FP | Single-Chip Microcomputer |
| HD6473802 | Single-Chip Microcomputer |
| HD6473802FP | Single-Chip Microcomputer |
| HD6473802H | Single-Chip Microcomputer |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| HD6433436VF10 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:16-Bit Microcontroller |
| HD6433436VTF10 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:16-Bit Microcontroller |
| HD6433436W | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Single-Chip Microcomputer |
| HD6433436WF | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Single-Chip Microcomputer |
| HD6433436WF12 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:16-Bit Microcontroller |
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