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參數(shù)資料
| 型號： | HD6433837L |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 5 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | TQFP-100 |
| 文件頁數(shù)： | 12/194頁 |
| 文件大?。?/td> | 2303K |
| 代理商： | HD6433837L |
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109
8272E–AVR–04/2013
ATmega164A/PA/324A/PA/644A/PA/1284/P
15.9.6
TIMSK0 – Timer/Counter Interrupt Mask Register
Bits 7:3 – Reserved
These bits are reserved and will always read as zero.
Bit 2 – OCIE0B: Timer/Counter Output Compare Match B Interrupt Enable
When the OCIE0B bit is written to one, and the I-bit in the Status Register is set, the
Timer/Counter Compare Match B interrupt is enabled. The corresponding interrupt is executed if
a Compare Match in Timer/Counter occurs, that is, when the OCF0B bit is set in the
Timer/Counter Interrupt Flag Register – TIFR0.
Bit 1 – OCIE0A: Timer/Counter0 Output Compare Match A Interrupt Enable
When the OCIE0A bit is written to one, and the I-bit in the Status Register is set, the
Timer/Counter0 Compare Match A interrupt is enabled. The corresponding interrupt is executed
if a Compare Match in Timer/Counter0 occurs, that is, when the OCF0A bit is set in the
Timer/Counter 0 Interrupt Flag Register – TIFR0.
Bit 0 – TOIE0: Timer/Counter0 Overflow Interrupt Enable
When the TOIE0 bit is written to one, and the I-bit in the Status Register is set, the
Timer/Counter0 Overflow interrupt is enabled. The corresponding interrupt is executed if an
overflow in Timer/Counter0 occurs, that is, when the TOV0 bit is set in the Timer/Counter 0 Inter-
rupt Flag Register – TIFR0.
15.9.7
TIFR0 – Timer/Counter 0 Interrupt Flag Register
Bits 7:3 – Reserved
These bits are reserved and will always read as zero.
Bit 2 – OCF0B: Timer/Counter 0 Output Compare B Match Flag
The OCF0B bit is set when a Compare Match occurs between the Timer/Counter and the data in
OCR0B – Output Compare Register0 B. OCF0B is cleared by hardware when executing the cor-
responding interrupt handling vector. Alternatively, OCF0B is cleared by writing a logic one to
the flag. When the I-bit in SREG, OCIE0B (Timer/Counter Compare B Match Interrupt Enable),
and OCF0B are set, the Timer/Counter Compare Match Interrupt is executed.
Bit 1 – OCF0A: Timer/Counter 0 Output Compare A Match Flag
The OCF0A bit is set when a Compare Match occurs between the Timer/Counter0 and the data
in OCR0A – Output Compare Register0. OCF0A is cleared by hardware when executing the cor-
responding interrupt handling vector. Alternatively, OCF0A is cleared by writing a logic one to
the flag. When the I-bit in SREG, OCIE0A (Timer/Counter0 Compare Match Interrupt Enable),
and OCF0A are set, the Timer/Counter0 Compare Match Interrupt is executed.
Bit
7
6
5
4
3
2
1
0
–
OCIE0B
OCIE0A
TOIE0
TIMSK0
Read/Write
RRRR
R
R/W
Initial Value
0
Bit
7
6
543210
–
–OCF0B
OCF0A
TOV0
TIFR0
Read/Write
RRRRR
R/W
Initial Value
0
000000
相關PDF資料 |
PDF描述 |
|---|---|
| HD6433837SH | 8-BIT, MROM, 5 MHz, MICROCONTROLLER, PQFP100 |
| HD64463 | MULTIFUNCTION PERIPHERAL, PBGA387 |
| HD6473258CP10 | 8-BIT, OTPROM, MICROCONTROLLER, PQCC68 |
| HD74AC174T | D FLIP-FLOP, PDSO16 |
| HD74HC149FP | HC/UH SERIES, 8-BIT ENCODER, PDSO20 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| HD6433837S | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:H8/3834 Series H8/3837 HD6433837.HD6433837S.HD64473837. H8/3836 HD6433836.HD6433836S H8/3835 HD6433835.HD6433835S H8/3834 HD6433834.HD633834S.HD6473834 H8/3833 HD6433833.HD6433833S H8/3832 HD6433832S Hardware Manual |
| HD6433837SD | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:single-chip microcomputers |
| HD6433837SE | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:single-chip microcomputers |
| HD6433837SF | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:single-chip microcomputers |
| HD6433837SH | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:single-chip microcomputers |
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