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參數(shù)資料
| 型號： | HD66325A |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | 64-level Grayscale Driver for the TFT Liquid Crystal Display for XGA Systems(高品質(zhì)TFT LCD的64級灰度驅(qū)動器) |
| 中文描述： | 64級灰度驅(qū)動的TFT液晶顯示技術(shù)的XGA系統(tǒng)（高品質(zhì)TFT液晶顯示器的64級灰度驅(qū)動器） |
| 文件頁數(shù)： | 24/28頁 |
| 文件大小： | 142K |
| 代理商： | HD66325A |
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HD66325A
24
AC Characteristics 1 (Conditions (unless otherwise specified): V
CC
– GND = 3.0 V to 3.6 V, V
LCD
– GND = 5.0 V to 7.0 V, Ta = –30
°
C to +75
°
C, Tr = Tf = 8 ns)
Item
Symbol
Applicable
Pins
Min.
Typ.
Max.
Unit
Conditions
Notes
Clock cycle time
Trate
CL2
25
ns
Clock low-level width
Tcwl
CL2
4
ns
Clock high-level width
Tcwh
CL2
4
ns
Data setup time
Tds
Dij and CL2
4
ns
Data hold time
Tdh
Dij and CL2
3
ns
Start pulse setup time
Tss
EIO1, EIO2,
and CL2
3
ns
Start pulse hold time
Tsh
EIO1, EIO2,
and CL2
3
ns
POL1, 2 setup time
Tps
POL1, POL2,
and CL2
4
ns
POL1, 2 hold time
Tph
POL1, POL2,
and CL2
3
ns
Start pulse low period
Tspl
EIO1, EIO2,
and CL1
2
CLK
CL1 high-level width
Tcl1wh
CL1
200
ns
Data invalid period
Tinv
CL1 and CL2
1
CLK
Last data timing
Tldt
CL1 and CL2
1
CLK
CL1 setup time
Tcs
CL1 and CL2
2
ns
CL1 hold time
Tch
CL1 and CL2
2
ns
Time between CL1
start pulses
Tcl1-eio
CL1, EIO1, and
EIO2
2
CLK
M setup time
Tms
M and CL1
5
ns
M hold time
Tmh
M and CL1
5
ns
Start pulse delay time
Tsd
EIO1, EIO2,
and CL2
22
ns
CL = 25 pF
Driver output delay
time 1
(load condition 1)
Tdd1
CL1 and
Y1 to Y384
2.5
4
μ
s
V
= 7 V
90% write
1
Tdd2
CL1 and
Y1 to Y384
5
7
μ
s
V
= 7 V
6-bit
precision
Driver output delay
time 2
(load condition 2)
Tdd3
CL1 and
Y1 to Y384
6
7
μ
s
V
= 7 V
90% write
2
Tdd4
CL1 and
Y1 to Y384
10
12
μ
s
V
= 7 V
6-bit
precision
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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