參數(shù)資料
型號： HM5251165B
廠商： Hitachi,Ltd.
英文描述： 512-Mbit SDRAM(512M位同步RAM)
中文描述： 512兆位的SDRAM（512M位同步內存）
文件頁數(shù)： 56/64頁
文件大?。?/td> 1030K
代理商： HM5251165B
HM5251165B/HM5251805B/HM5251405B-75/A6/B6
56
Mode Register Set Cycle
M
RAS
-
CAS
delay = 3
CAS
latency = 3
Burst length = 4
= V or V
IL
N
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
CLK
CKE
CS
RAS
CAS
WE
BS
Address
DQM,
DQMU/DQML
DQ (output)
DQ (input)
@
H
I
&
'
/
0
M
N
H
P.
Bank 0
/
7
@
&
'
/
%
-
.
-
6
>
Write
Active
G
O
P
C
D
L
M
%
&
High-Z
b
b+3
b’
b’+1
b’+2
b’+3
l
valid
C: b’
RSA
code
lRCD
lRP
Precharge
If needed
Mode
register
Set
Bank 3
Active
Bank 3
Read
@
H
I
/
8
9
@
A
/
7
8
@
D
L
M
'
(
/
0
9
(
6
@
H
6
GH
P%
.
/
7
%
&
/
R: b
C: b
.
7
@
H
P
4
R:b
C:b
C:b'
C:b"
=
>
E
F
Output mask
V
IH
l = 3
CAS
latency = 3
Burst length = 4
= V or V
IH
IL
RCD
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
R:a
C:a
R:b
C:b
C:b'
C:b"
a
a+1 a+2 a+3
b
b+1 b+2 b+3 b'
b'+1 b"
b"+1 b"+2 b"+3
CKE
RAS
CAS
WE
CS
Address
DQMU/DQM,
DQ (output)
DQ (input)
CLK
BS
=
F
O
<
=
E
=
E
F
F
O
=
E
F
O
R:a
C:a
a
a+1 a+2 a+3
b
b+1 b+2 b+3 b'
b'+1 b"
b"+1b"+2 b"+3
H
I
H
I
A
J
8
A
I
J
7
8
@
A
I
A
I
J
8
@
A
I
I
J
@
H
I
I
J
@
H
I
9
:
B
0
9
B
0
8
9
/
0
8
9
/
0
8
A
1
:
'
0
1
'
0
0
1
'
0
5
>
F
G
4
5
=
F
+
4
5
=
5
=
>
F
G
5
=
>
F-
56
>
+
,
4
5
5
>
,
5
>
,
4
5$
%
-
6
#$
,
5
#
,
5$
-
5$
,
5$
%
$
$
$
%
'
(
)
!
)
(
)
1
:
(
)
1
'
(
1
'
(
K
L
B
K
L
B
J
K
B
J
K
J
A
B
J
K
Bank 0
Bank 0
Bank 3
Bank 3
Bank 3
Bank 3
Bank 0
Bank 3
Bank 3
Bank 3
Bank 3
Bank 0
Bank 3
CKE
RAS
CS
CAS
WE
Address
DQM,
DQMU/DQML
DQ (output)
DQ (input)
BS
High-Z
High-Z
4
5
=
E
F
$
%
&
/
7
8
@
I
1
9
:
B
C
K
V
IH
V
IH
Read cycle
RAS
-
CAS
delay = 3
CAS
latency = 3
Burst length = 4
= V or V
IH
IL
Write cycle
!
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PDF描述
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HM5257165B 512M LVTTL interface SDRAM 133 MHz/100 MHz 8-Mword 】 16-bit 】 4-bank/16-Mword 】 8-bit 】 4-bank /32-Mword 】 4-bit 】 4-bank PC/133, PC/100 SDRAM
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