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參數(shù)資料
| 型號： | HM5264165A60 |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | 64M LVTTL interface SDRAM 133 MHz/100 MHz |
| 中文描述： | 6400 LVTTL接口SDRAM的133 MHz/100 MHz的 |
| 文件頁數(shù)： | 60/67頁 |
| 文件大小： | 870K |
| 代理商： | HM5264165A60 |
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HM5264165F/HM5264805F/HM5264405F-75/A60/B60
60
Full Page Read/Write Cycle
High-Z
P
Z
[
R:a
C:a
R:b
Z
[
D
E
N
O
:
D
N
:
D
E
N
E
N
O
D
E
N
R:a
C:a
R:b
High-Z
Z
[
R
[
\
Q
R
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G
P
Q
[
R
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\
G
Q
R
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S
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Q
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G
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R
2
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O
1
:
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1
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E
O
1
E(
2
<
'(
1(
2
12
(
W
Bank 0
Active
Bank 0
Read
Bank 3
Active
Burst stop
Bank 3
Precharge
Bank 0
Active
Bank 0
Write
Bank 3
Active
Burst stop
Bank 3
Precharge
6
@
I
R
S
5
6
@
H
I
R
5
6
>
H
I
R
+
5
6
>
H
R
+
4
5
>
H
"
#
+
,
5
6
#
,
-
6
7
@
#
,
-
5
6
@
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#
,
-
5
6
#
#
#
I
J
S
T
]
J
S
T
]
J
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T
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^
S
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"
+
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5
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^
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^
S
]
(
)
(
)
(
(
(
I
J
R
S
\
]
CKE
RAS
CS
CAS
WE
Address
DQM,
DQMU/DQML
DQ (output)
DQ (input)
CLK
BS
CKE
RAS
CS
CAS
WE
BS
Address
DQM,
DQMU/DQML
DQ (output)
:
;
D
E
M
N
4
=
>
G
H
Q
V
IH
V
IH
a
a+1
a+2
a+3
Read cycle
RAS-CAS delay = 3
CAS latency = 3
Burst length = full page
= V or V
IL
Write cycle
RAS-CAS delay = 3
CAS latency = 3
Burst length = full page
= V or V
IL
a
a+1
a+2
a+3
a+6
a+5
a+4
DQ (input)
相關PDF資料 |
PDF描述 |
|---|---|
| HM5264165B60 | 64M LVTTL interface SDRAM 133 MHz/100 MHz |
| HM5264165FTT-75 | 64M LVTTL interface SDRAM 133 MHz/100 MHz |
| HM5264805FTT-75 | 64M LVTTL interface SDRAM 133 MHz/100 MHz |
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| HM5264165FTT-A60 | 64M LVTTL interface SDRAM 133 MHz/100 MHz |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| HM5264165D-B60/4805D-B60/4405D-B60 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:64M LVTTL Interface SDRAM 100 MHz 1-Mword X 1 |
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| HM5264165DLTT-B60 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x16 SDRAM |
| HM5264165DTT-80 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x16 SDRAM |
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