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參數(shù)資料
| 型號(hào)： | HYB514800BJ |
| 廠商： | SIEMENS AG |
| 英文描述： | 512kx8-Bit Dynamic RAM |
| 中文描述： | 512kx8位動(dòng)態(tài)隨機(jī)存儲(chǔ)器 |
| 文件頁(yè)數(shù)： | 22/22頁(yè) |
| 文件大?。?/td> | 211K |
| 代理商： | HYB514800BJ |
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Semiconductor Group
146
CAS-Before-RAS Refresh Counter Test Cycle
t
CSR
t
ASR
t
ASC
t
CHR
t
CPT
t
WRP
t
RAL
t
CAH
t
RSH
t
CAS
t
RP
t
RAS
t
RCS
t
CDD
t
CAC
t
AA
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WRH
t
OEA
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ODD
t
CLZ
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DZC
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DZO
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OEZ
t
OFF
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RWL
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CWL
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WCH
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WCS
t
WRH
t
WRP
t
DS
t
ODD
t
OEZ
t
DH
t
WRH
t
WRP
t
RWL
t
CWL
t
AWD
t
CWD
t
WP
t
RCS
t
CAC
t
OEA
t
OEH
t
AA
t
CLZ
t
DH
DZO
t
DS
t
DZC
t
CAC
V
IH
VIL
VIH
VIL
VIH
VIL
VIH
VIL
VIH
VIL
VIH
VIL
VOH
VOL
VOH
VOL
VIH
VIL
VIH
VIL
VIH
VIL
VIH
VIL
VIH
VIL
VIH
VIL
VIH
VIL
I/O1-I/O8
(Inputs)
RAS
I/O1-I/O8
(Inputs)
OE
WRITE
A0-A9
CAS
I/O1-I/O8
(Outputs)
I/O1-I/O8
(Outputs)
Read-Modify-Write Cycle
I/O1-I/O8
(Inputs)
WRITE
OE
WRITE
OE
I/O1-I/O8
(Outputs)
Column
Row
Address
t
RRH
t
RCH
Data In
Valid DataOut
Valid
Data In
HI-Z
HI-Z
HI-Z
Read Cycle
Write Cycle
D.Out
HYB 514800BJ -60/-70/-80
512k x 8 DRAM
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| HYB514800BJ-60 | 512kx8-Bit Dynamic RAM |
| HYBRID-1998 | |
| HYBRID-CAPABILITIES | Optoelectronic |
| HYBRID-CUSTOM | ASIC |
| HYC9088AR-LF | ARCNET Twisted Pair and Coaxial Compatible High Impedance Transceiver HIT |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| HYB514800BJ-60 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:512kx8-Bit Dynamic RAM |
| HYB514800BJ-70 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:512kx8-Bit Dynamic RAM |
| HYB514800BJ-80 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:512kx8-Bit Dynamic RAM |
| HYB514800BJL-60 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x8 Fast Page Mode DRAM |
| HYB514800BJL-70 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x8 Fast Page Mode DRAM |
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