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參數(shù)資料
| 型號： | HYS 64V32220GD(L)-8A |
| 廠商： | SIEMENS AG |
| 英文描述： | 3.3V SDRAM Modules(3.3V SDRAM 模塊) |
| 中文描述： | 3.3V的內存模塊（3.3V的內存模塊） |
| 文件頁數(shù)： | 7/12頁 |
| 文件大?。?/td> | 90K |
| 代理商： | HYS 64V32220GD(L)-8A |
HYS64V32220GD(L)-8A
PC100 144 pin SO-DIMM SDRAM Modules
INFINEON Technologies
7
AC Characteristics
1)2)
T
A
= 0 to 70
°
C;
V
SS
= 0 V;
V
CC
= 3.3 V
±
0.3 V,
t
T
= 1 ns
Parameter
Symbol
Limit Values
Unit
-8A
PC100-322
min.
max.
Clock and Access Time
Clock Cycle Time
CAS Latency = 3
CAS Latency = 2
t
CK
10
15
–
–
ns
ns
Clock Frequency
CAS Latency = 3
CAS Latency = 2
t
CK
–
–
100
66
MHz
MHz
Access Time from Clock
CAS Latency = 3
CAS Latency = 2
t
AC
–
–
6
6
ns
ns
2,
3
Clock High Pulse Width
t
CH
t
CL
t
T
3
–
ns
Clock Low Pulse Width
3
–
ns
Transition time
0.5
10
ns
Setup and Hold Parameter
Input Setup Time
t
IS
t
IH
t
SB
t
PDE
t
RSC
2
–
ns
4
Input Hold Time
1
–
ns
4
Power Down Mode Entry Time
1
–
CLK
4
Power Down Mode Exit Setup Time
1
–
CLK
4
Mode Register Set-up time
2
–
CLK
Common Parameters
Row to Column Delay Time
t
RCD
t
RP
t
RAS
t
RC
t
RRD
20
ns
5
Row Precharge Time
20
ns
5
Row Active Time
50
100k
ns
5
Row Cycle Time
70
–
ns
5
Activate(a) to Activate(b) Command
period
20
ns
5
CAS(a) to CAS(b) Command period
t
CCD
1
–
CLK
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PDF描述 |
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