參數(shù)資料
型號(hào): HYS64V4220GU-10
廠商: SIEMENS A G
元件分類: DRAM
英文描述: 3.3V 2M x 64/72-Bit 1 BANK SDRAM Module 3.3V 4M x 64/72-Bit 2 BANK SDRAM Module
中文描述: 4M X 64 SYNCHRONOUS DRAM MODULE, 8 ns, DMA168
封裝: DIMM-168
文件頁數(shù): 4/17頁
文件大?。?/td> 104K
代理商: HYS64V4220GU-10
HYS64(72)V2200/4220GU-8/-10
SDRAM-Modules
Semiconductor Group
4
Block Diagram for 2M x 64/72 SDRAM DIMM modules (HYS64/72V2200GU)
CS WE
DQM
DQ0-DQ7
D1
CS WE
DQM
DQ0-DQ7
D0
CS WE
DQM
DQ0-DQ7
D8
CS WE
DQM
DQ0-DQ7
D2
CS WE
DQM
DQ0-DQ7
D3
CS WE
DQM
DQ0-DQ7
D5
CS WE
DQM
DQ0-DQ7
D4
CS WE
DQM
DQ0-DQ7
D6
CS WE
DQM
DQ0-DQ7
D7
WE
CS0
DQMB0
DQ(7:0)
DQMB1
DQ(15:8)
CB(7:0)
DQMB2
DQ(23:16)
DQMB3
DQ(31:24)
DQMB4
DQ(39:32)
DQMB5
DQ(47:40)
DQMB6
DQ(55:48)
DQMB7
DQ(63:56)
A0-A10,BA
VCC
VSS
D0 - D7,(D8)
C0-C7,(C8)
WP
SDA
SA0
SA1
SA2
SCL
E
2
PROM (256wordx8bit)
SA0
SA1
SA2
SCL
D0 - D7,(D8)
D0 - D7,(D8)
D0 - D7,(D8)
D0 - D7,(D8)
D0 - D7,(D8)
RAS
CAS
CKE0
Note: D8 is only used in the x72 ECC version
CS2
47k
Clock Wiring
2M x 64 2M x 72
CLK0 4 SDRAM+3.3pF 5 SDRAM
CLK1 Termination Termination
CLK2 4 SDRAM+3.3pF 4 SDRAM+3.3pF
CLK3 Termination Termination
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PDF描述
HYS72V4220GU-10 3.3V 2M x 64/72-Bit 1 BANK SDRAM Module 3.3V 4M x 64/72-Bit 2 BANK SDRAM Module
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參數(shù)描述
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