參數(shù)資料
型號： ICS650R-12LFT
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 2/7頁
文件大小： 0K
描述： IC MPEG CLK SYNTHESIZER 20-SSOP
標(biāo)準(zhǔn)包裝： 2,500
類型： 時鐘/頻率合成器
PLL： 是
輸入： 時鐘，晶體
輸出： 時鐘
電路數(shù)： 1
比率 - 輸入:輸出： 1:6
差分 - 輸入:輸出： 無/無
頻率 - 最大： 108MHz
除法器/乘法器： 是/無
電源電壓： 3 V ~ 5.5 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 20-SSOP（0.154"，3.90mm 寬）
供應(yīng)商設(shè)備封裝： 20-QSOP
包裝： 帶卷 (TR)
其它名稱： 650R-12LFT
ICS650-12
MPEG CLOCK SYNTHESIZER
CLOCK SYNTHESIZER
IDT / ICS MPEG CLOCK SYNTHESIZER
2
ICS650-12
REV E 051310
Pin Assignment
PCLK1 and PCLK2 Select Table (in MHz)
ACLK Select Table (in MHz)
CCLK Select Table (in MHz)
*Note: Entire chip powers-down (outputs stop low) when
CS1=CS0=0.
PS2
PS1
PS0
PCLK1
PCLK2
0
108.00
54.00
0
1
55.00
27.5
0
1
0
66.67
33.33
0
1
80.00
40.00
1
0
54.00
27.00
1
0
1
81.00
40.5
1
0
50.00
25.00
1
60.00
30.00
13
4
12
5
11
CS1
8
9
10
VDD
PCLK1
13.5M
AS0
CS0
27M
17
16
AS2
3
X1
VDD
PCLK2
18
CCLK
1
PS2
X2
PS0
20
PS1
19
14
2
7
GND
ACLK
AS1
GND
15
6
20-pin SSOP (QSOP)
AS2
AS1
AS0
ACLK
0
12.288
0
1
11.2896
0
1
0
8.192
0
1
24.576
1
0
8.192
1
0
1
16.9344
1
0
18.432
1
11.2896
CS1
CS0
CCLK
00All off*
01
20.00
1
0
66.6666
1
24.576
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PDF描述
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