FEMTOCLOCK
參數(shù)資料
型號: ICS844004AKI-104LF
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 14/18頁
文件大小: 0K
描述: IC SYNTHESIZER LVDS 32-VFQFPN
標(biāo)準(zhǔn)包裝: 490
系列: HiPerClockS™, FemtoClock™
類型: 頻率合成器
PLL: 帶旁路
輸入: LVCMOS,LVTTL,晶體
輸出: LVDS
電路數(shù): 1
比率 - 輸入:輸出: 2:4
差分 - 輸入:輸出: 無/是
頻率 - 最大: 226.66MHz
除法器/乘法器: 是/無
電源電壓: 2.375 V ~ 3.465 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 32-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝: 32-VFQFPN 裸露焊盤(4x4)
包裝: 托盤
其它名稱: 800-2242
844004AKI-104LF
ICS844004AKI-104LF-ND
ICS844004AKI-104 REVISION A DECEMBER 15, 2010
5
2010 Integrated Device Technology, Inc.
ICS844004I-104 Data Sheet
FEMTOCLOCK CRYSTAL-TO-LVDS FREQUENCY SYNTHESIZER
AC Electrical Characteristics
Table 5A. AC Characteristics, VDD = VDDO = 3.3V ± 5%, TA = -40°C to 85°C
NOTE: Electrical parameters are guaranteed over the specified ambient operating temperature range, which is established when the device is
mounted in a test socket with maintained transverse airflow greater than 500 lfpm. The device will meet specifications after thermal equilibrium
has been reached under these conditions.
NOTE 1: Defined as skew between outputs at the same supply voltages and with equal load conditions. Measured at the differential cross
points.
NOTE 2: This parameter is defined in accordance with JEDEC Standard 65.
NOTE 3: Please refer to the Phase Noise Plots.
Table 5B. AC Characteristics, VDD = VDDO = 2.5V ± 5%, TA = -40°C to 85°C
NOTE: Electrical parameters are guaranteed over the specified ambient operating temperature range, which is established when the device is
mounted in a test socket with maintained transverse airflow greater than 500 lfpm. The device will meet specifications after thermal equilibrium
has been reached under these conditions.
NOTE 1: Defined as skew between outputs at the same supply voltages and with equal load conditions. Measured at the differential cross
points.
NOTE 2: This parameter is defined in accordance with JEDEC Standard 65.
NOTE 3: Please refer to the Phase Noise Plots.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
fOUT
Output Frequency
F_SEL[1:0] = 00
186.67
226.66
MHz
F_SEL[1:0] = 01
140
170
MHz
F_SEL[1:0] = 10
93.33
113.33
MHz
F_SEL[1:0] = 11
46.67
56.66
MHz
tsk(o)
Output Skew; NOTE 1, 2
35
ps
tjit()
RMS Phase Jitter, Random;
NOTE 3
212.5MHz, (637kHz - 10MHz)
0.73
ps
159.375MHz, (637kHz - 10MHz)
0.78
ps
106.25MHz, (637kHz -10MHz)
0.92
ps
53.125MHz, (637kHz - 10MHz)
0.95
ps
187.5MHz, (637kHz - 10MHz)
0.75
ps
tR / tF
Output Rise/Fall Time
20% to 80%
250
500
ps
odc
Output Duty Cycle
F_SEL[1:0]
≠ ÷3
48
52
%
F_SEL[1:0] = ÷3
40
60
%
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
fOUT
Output Frequency
F_SEL[1:0] = 00
186.67
226.66
MHz
F_SEL[1:0] = 01
140
170
MHz
F_SEL[1:0] = 10
93.33
113.33
MHz
F_SEL[1:0] = 11
46.67
56.66
MHz
tsk(o)
Output Skew; NOTE 1, 2
35
ps
tjit()
RMS Phase Jitter, Random;
NOTE 3
212.5MHz, (637kHz - 10MHz)
0.72
ps
159.375MHz, (637kHz - 10MHz)
0.88
ps
106.25MHz, (637kHz -10MHz)
0.89
ps
53.125MHz, (637kHz - 10MHz)
0.96
ps
187.5MHz, (637kHz - 10MHz)
0.74
ps
tR / tF
Output Rise/Fall Time
20% to 80%
250
550
ps
odc
Output Duty Cycle
F_SEL[1:0]
≠ ÷3
48
52
%
F_SEL[1:0] = ÷3
40
60
%
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