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參數(shù)資料
| 型號(hào)： | ICS844004AKI-104LF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 2/18頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC SYNTHESIZER LVDS 32-VFQFPN |
| 標(biāo)準(zhǔn)包裝： | 490 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 類型： | 頻率合成器 |
| PLL： | 帶旁路 |
| 輸入： | LVCMOS，LVTTL，晶體 |
| 輸出： | LVDS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:4 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 226.66MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 2.375 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-VFQFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 32-VFQFPN 裸露焊盤（4x4） |
| 包裝： | 托盤 |
| 其它名稱： | 800-2242 844004AKI-104LF ICS844004AKI-104LF-ND |
ICS844004AKI-104 REVISION A DECEMBER 15, 2010
10
2010 Integrated Device Technology, Inc.
ICS844004I-104 Data Sheet
FEMTOCLOCK CRYSTAL-TO-LVDS FREQUENCY SYNTHESIZER
Recommendations for Unused Input and Output Pins
Inputs:
LVCMOS Control Pins
All control pins have internal pulldowns; additional resistance is not
required but can be added for additional protection. A 1k
resistor
can be used.
REF_CLK Input
For applications not requiring the use of the reference clock,
it can be left floating. Though not required, but for additional
protection, a 1k
resistor can be tied from the REF_CLK to ground.
Outputs:
LVDS Outputs
All unused LVDS output pairs can be either left floating or terminated
with 100
across. If they are left floating, we recommend that there
is no trace attached.
LVDS Driver Termination
A general LVDS interface is shown in Figure 4. Standard termination
for LVDS type output structure requires both a 100
parallel resistor
at the receiver and a 100
differential transmission line environment.
In order to avoid any transmission line reflection issues, the 100
resistor must be placed as close to the receiver as possible. IDT
offers a full line of LVDS compliant devices with two types of output
structures: current source and voltage source. The standard
termination schematic as shown in Figure 4 can be used with either
type of output structure. If using a non-standard termination, it is
recommended to contact IDT and confirm if the output is a current
source or a voltage source type structure. In addition, since these
outputs are LVDS compatible, the amplitude and common mode
input range of the input receivers should be verified for compatibility
with the output.
Figure 4. Typical LVDS Driver Termination
100
–
+
100
Differential Transmission Line
LVDS Driver
LVDS
Receiver
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PDF描述 |
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參數(shù)描述 |
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