LOW SKEW
參數(shù)資料
型號(hào): ICS87950BYILFT
廠商: IDT, Integrated Device Technology Inc
文件頁(yè)數(shù): 12/13頁(yè)
文件大?。?/td> 0K
描述: IC CLOCK MULT 1-9 32-LQFP
標(biāo)準(zhǔn)包裝: 1,000
系列: HiPerClockS™
類型: 時(shí)鐘乘法器
PLL: 帶旁路
輸入: LVCMOS,LVTTL,晶體
輸出: LVCMOS,LVTTL
電路數(shù): 1
比率 - 輸入:輸出: 2:9
差分 - 輸入:輸出: 無(wú)/無(wú)
頻率 - 最大: 250MHz
除法器/乘法器: 是/無(wú)
電源電壓: 3.135 V ~ 3.465 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 32-LQFP
供應(yīng)商設(shè)備封裝: 32-TQFP(7x7)
包裝: 帶卷 (TR)
其它名稱: 87950BYILFT
87950BYI
www.idt.com
REV. C JULY 16, 2010
ICS87950I
LOW SKEW, 1-TO-9
LVCMOS / LVTTL CLOCK MULTIPLIER
8
FIGURE 2. CRYSTAL INPUT INTERFACE
CRYSTAL INPUT INTERFACE
The ICS87950I has been characterized with 18pF parallel
resonant crystals. The capacitor values, C1 and C2, shown in
Figure 2 below were determined using a 25MHz, 18pF parallel
resonant crystal and were chosen to minimize the ppm error.
These same capacitor values will tune any 18pF parallel reso-
nant crystal over the frequency range and other parameters
specified in this data sheet. The optimum C1 and C2 values
can be slightly adjusted for different board layouts.
As in any high speed analog circuitry, the power supply pins are
vulnerable to random noise. The ICS87950I provides separate
power supplies to isolate any high switching noise from the out-
puts to the internal PLL. V
DDO and VDDA should be individually
connected to the power supply plane through vias, and bypass
capacitors should be used for each pin. To achieve optimum
jitter performance, power supply isolation is required.
Figure 1
illustrates how a 10
Ω resistor along with a 10μF and a .01μF
bypass capacitor should be connected to each V
DDA pin.
POWER SUPPLY FILTERING TECHNIQUES
FIGURE 1. POWER SUPPLY FILTERING
10
Ω
V
DDA
10
μF
.01
μF
3.3V
.01
μF
V
DDO
APPLICATION INFORMATION
ICS84332
XTAL_IN
XTAL_OUT
X1
18pF Parallel Cry stal
C2
22p
C1
22p
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PDF描述
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參數(shù)描述
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