參數(shù)資料
型號(hào)： ICS93732G-T
英文描述： Low Cost DDR Phase Lock Loop Zero Delay Buffer
中文描述： 低成本的DDR鎖相環(huán)零延遲緩沖器
文件頁數(shù)： 8/8頁
文件大?。?/td> 491K
代理商： ICS93732G-T
8
ICS93732
0578H—02/19/04
4.40 mm. Body, 0.65 mm. pitch TSSOP
(173 mil)
(0.0256 Inch)
AREA
INDEX
1 2
N
D
E1
E
α
PLANE
SEATING
A1
A
A2
e
- C -
b
c
L
aaa
C
Ordering Information
ICS93732
y
G -T
Designation for tape and reel packaging
Package Type
G = TSSOP
Revision Designator
(will not correlate with datasheet revision)
Device Type
Prefix
ICS = Standard Device
Example:
ICS XXXX
y
G - T
MIN
--
0.05
0.80
0.19
0.09
SEE VARIATIONS
6.40 BASIC
MAX
1.20
0.15
1.05
0.30
0.20
MIN
--
.002
.032
.007
.0035
SEE VARIATIONS
0.252 BASIC
MAX
.047
.006
.041
.012
.008
A
A1
A2
b
c
D
E
E1
e
L
N
α
aaa
4.30
4.50
.169
.177
0.45
SEE VARIATIONS
0.75
.018
SEE VARIATIONS
.030
0°
--
8°
0°
--
8°
0.10
.004
VARIATIONS
MIN
9.60
MAX
9.80
MIN
.378
MAX
.386
28
10-0035
SYMBOL
In Millimeters
COMMON DIMENSIONS
In Inches
COMMON DIMENSIONS
0.65 BASIC
0.0256 BASIC
N
D mm.
D (inch)
Reference Doc.: JEDEC Publication 95, MO-153
相關(guān)PDF資料
PDF描述
ICS93732 Low Cost DDR Phase Lock Loop Zero Delay Buffer
ICS93732FLF-T Low Cost DDR Phase Lock Loop Zero Delay Buffer
ICS93735 DDR Phase Lock Loop Zero Delay Clock Buffer
ICS93735F-T DDR Phase Lock Loop Zero Delay Clock Buffer
ICS93738 DDR and SDRAM Buffer
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參數(shù)描述
ICS93735 制造商:ICS 制造商全稱:ICS 功能描述:DDR Phase Lock Loop Zero Delay Clock Buffer
ICS93735F-T 制造商:ICS 制造商全稱:ICS 功能描述:DDR Phase Lock Loop Zero Delay Clock Buffer
ICS93738 制造商:ICS 制造商全稱:ICS 功能描述:DDR and SDRAM Buffer
ICS93772AF 功能描述:IC DDR PLL ZD BUFFER 28-SSOP RoHS:否 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 專用 系列:- 標(biāo)準(zhǔn)包裝:1,500 系列:- 類型:時(shí)鐘緩沖器/驅(qū)動(dòng)器 PLL:是 主要目的:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 電源電壓:3.3V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:28-SSOP（0.209"，5.30mm 寬） 供應(yīng)商設(shè)備封裝:28-SSOP 包裝:帶卷 (TR) 其它名稱:93786AFT
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