參數(shù)資料
型號： ICS952623YGT
英文描述： Programmable Timing Control Hub for Next Gen P4 processor
中文描述： 可編程定時控制中心，為下一代P4處理器
文件頁數(shù)： 23/27頁
文件大?。?/td> 329K
代理商： ICS952623YGT
23
Integrated
Circuit
Systems, Inc.
ICS952623
Advance Information
0758—02/08/05
The following diagrams illustrate SRC clock timing during PCI_Stop# and PwrDwn# modes with SRC_Pwrdwn and
SRC_Stop tristate control bits set to driven or tristate in byte 2 of the control register.
SRC_Stop = Driven, SRC_Pwrdwn = Driven
PCI_Stop#
1.8mS
PWRDWN#
PCI (Free Running)
CPU (Free Running)
CPU# (Free Running)
SRC (Stoppable)
SRC# (Stoppable)
1 PCI
clock max
Notes:
1. When both bits (SRC_Stop & SRC_Pwrdown tristate bits) are set to driven, the clock chip will never tristate the SRC output
clock (assuming clock's OE bit is set to "1")
SRC Clock Tristate Timing
SRC_Stop = Tristate, Pwrdwn = Tristate
PCI_Stop#
1.8mS
PWRDWN#
PCI (Free Running)
CPU (Free Running)
CPU# (Free Running)
SRC (Stoppable)
SRC# (Stoppable)
1 PCI
clock max
Notes:
1. When SRC_Stop and SRC_Pwrdwn bits are set to tristate, the clock chip will tristate outputs during the assertion of
PCI_Stop# and PWRDWN#.
2. Tristate outputs are pulled low by output termination resistors as shown here.
相關(guān)PDF資料
PDF描述
ICS952623 Programmable Timing Control Hub for Next Gen P4 processor
ICS952623YFT Programmable Timing Control Hub for Next Gen P4 processor
ICS952623YGT Programmable Timing Control Hub for Next Gen P4 processor
ICS95V847 2.5V Wide Range Frequency Clock Driver (45MHz - 233MHz)
ICS95V847YGLF-T 2.5V Wide Range Frequency Clock Driver (45MHz - 233MHz)
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參數(shù)描述
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