參數(shù)資料
型號： IDT5T9820NLGI8
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時鐘及定時
英文描述： 5T SERIES, PLL BASED CLOCK DRIVER, 10 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), QCC68
封裝： GREEN, PLASTIC, VFQFPN-68
文件頁數(shù)： 13/36頁
文件大小： 275K
代理商： IDT5T9820NLGI8
20
INDUSTRIALTEMPERATURERANGE
IDT5T9820
EEPROM PROGRAMMABLE 2.5V ZERO DELAY PLL CLOCK DRIVER
AC DIFFERENTIAL INPUT SPECIFICATIONS(1)
Symbol
Parameter
Min.
Typ.
Max
Unit
t W
Reference/Feedback Input Clock Pulse Width HIGH or LOW (HSTL/eHSTL outputs)(2)
1—
—
ns
Reference/Feedback Input Clock Pulse Width HIGH or LOW (2.5V / 1.8V LVTTL outputs)(2)
1—
—
HSTL/eHSTL/1.8V LVTTL/2.5V LVTTL
VDIF
ACDifferentialVoltage(3)
400
—
mV
VIH
AC Input HIGH(4,5)
Vx + 200
—
mV
VIL
AC Input LOW(4,6)
—
Vx - 200
mV
LVEPECL
VDIF
ACDifferentialVoltage(3)
400
—
mV
VIH
AC Input HIGH(4)
1275
—
mV
VIL
AC Input LOW(4)
—
875
mV
NOTES:
1. For differential input mode, Bits 35 - 30 = 1.
2. Both differential input signals should not be driven to the same level simultaneously. The input will not change state until the inputs have crossed and the voltage range defined
by VDIF has been met or exceeded.
3. Differential mode only. VDIF specifies the minimum input voltage (VTR - VCP) required for switching where VTR is the "true" input level and VCP is the "complement" input level.
The AC differential voltage must be achieved to guarantee switching to a new state.
4. For single-ended operation, REF[1:0]/VREF[1:0] is tied to the DC voltage VREF[1:0]. Refer to each input interface's DC specification for the correct VREF[1:0] range.
5. Voltage required to switch to a logic HIGH, single-ended operation only.
6. Voltage required to switch to a logic LOW, single-ended operation only.
相關(guān)PDF資料
PDF描述
IDT5T9820NLGI 5T SERIES, PLL BASED CLOCK DRIVER, 10 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), QCC68
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IDT5T9890NLI8 5T SERIES, PLL BASED CLOCK DRIVER, 10 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQCC68
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參數(shù)描述
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