參數(shù)資料
型號(hào)： IDT5V9351PFI8
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時(shí)鐘及定時(shí)
英文描述： 5V SERIES, PLL BASED CLOCK DRIVER, 9 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP32
封裝： TQFP-32
文件頁數(shù)： 4/10頁
文件大?。?/td> 96K
代理商： IDT5V9351PFI8
INDUSTRIALTEMPERATURERANGE
IDT5V9351
LOWVOLTAGEPLLCLOCKDRIVER
3
Terminal
Name
No.
Type
Description
PECL-CLK
8, 9
I
Differential clock reference, LOW voltage positive ECL input
PECL-CLK
TCLK
30
I
Single-ended reference clock signal or test clock
FBIN
2
I
Feedbacksignalinput
REF_SEL
32
I
Referenceclockinput
fSEL(D:A)
3, 4, 5, 6
I
Frequency control pin
OE
10
I
Outputenable/disable
QA
28
O
Bank A clock output
QB
26
O
Bank B clock output
QC(1:0)
22, 24
O
Bank C clock output
QD(4:0)
12, 14, 16,
O
Bank D clock output
18, 20
VCCA
1
PWR
Positive power supply for PLL
VCC
11, 15, 19,
PWR
Positive power supply for I/O and core
23, 27
GND
7, 13, 17, 21,
Ground
Negative power supply
25, 29
PLL_EN
31
I
PLL enable input. When set HIGH, PLL is enabled. When set LOW, PLL is disabled.
PIN DESCRIPTION
FUNCTIONALITY
Control
Default
0
1
REF_SEL
0
Selects PECL_CLK as reference clock
Selects TCLK as reference clock
PLL_EN
1
Test mode with PLL Disabled
PLL Enabled
OE
0
Outputsenabled
Outputsdisabled
FSELA
0
QA = VCO
÷ 2QA = VCO ÷ 4
FSELB
0
QB = VCO
÷ 4QB = VCO ÷ 8
FSELC
0
QC = VCO
÷ 4QC = VCO ÷ 8
FSELD
0
QD = VCO
÷ 4QD = VCO ÷ 8
NOTE:
1. Output frequency relationship with respect to input reference frequency CLK. QC1 is connected to FBIN.
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PDF描述
IDT5V9352PFI8 5V SERIES, PLL BASED CLOCK DRIVER, 11 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP32
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參數(shù)描述
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