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參數資料
| 型號： | IDT71V321S25TF |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | DRAM |
| 英文描述： | HIGH-SPEED 3.3V 2K x 8 DUAL-PORT STATIC RAM WITH INTERRUPT |
| 中文描述： | 2K X 8 DUAL-PORT SRAM, 25 ns, PQFP64 |
| 封裝： | STQFP-64 |
| 文件頁數： | 11/14頁 |
| 文件大?。?/td> | 129K |
| 代理商： | IDT71V321S25TF |
6.42
IDT71V321/71V421S/L
High Speed 3.3V 2K x 8 Dual-Port Static RAM with Interrupts Industrial and Commercial Temperature Ranges
11
34%54
%""$"")*#
!
NOTES:
1. 'X' in part numbers indicates power rating (S or L).
71V321X25
71V421X25
Com'l
& Ind
71V321X35
71V421X35
Com'l Only
71V321X55
71V421X55
Com'l Only
Symbol
Parameter
Min.
Max.
Min.
Max.
Min.
Max.
Unit
INTERRUPT TIMING
t
AS
Address Set-up Time
0
____
0
____
0
____
ns
t
WR
Write Recovery Time
0
____
0
____
0
____
ns
t
INS
Interrupt Set Time
____
25
____
25
____
45
ns
t
INR
Interrupt Reset Time
____
25
____
25
____
45
ns
3026 tbl 12
85@"'$
!
3
INT
73#
INT
NOTES:
.
1. All timng is the same for left and right ports. Port
“
A
”
may be either left or right port. Port
“
B
”
is the opposite fromport
“
A
”
.
2. See Interrupt Truth Table.
3. Timng depends on which enable signal (
CE
or R/
W
) is asserted last.
4. Timng depends on which enable signal (
CE
or R/
W
) is de-asserted first.
t
INS
ADDR
"A"
INT
"B"
INTERRUPT ADDRESS
t
WC
t
AS
R/
W
"A"
t
WR
3026 drw 14
(3)
(3)
(2)
(4)
t
RC
INTERRUPT CLEAR ADDRESS
ADDR
"B"
OE
"B"
t
INR
INT
"A"
3026 drw 15
t
AS
(3)
(3)
(2)
相關PDF資料 |
PDF描述 |
|---|---|
| IDT71V321S25TFI | HIGH-SPEED 3.3V 2K x 8 DUAL-PORT STATIC RAM WITH INTERRUPT |
| IDT71V321S35J | HIGH-SPEED 3.3V 2K x 8 DUAL-PORT STATIC RAM WITH INTERRUPT |
| IDT71V321S35JI | HIGH-SPEED 3.3V 2K x 8 DUAL-PORT STATIC RAM WITH INTERRUPT |
| IDT71V321S35PF | HIGH-SPEED 3.3V 2K x 8 DUAL-PORT STATIC RAM WITH INTERRUPT |
| IDT71V321S35PFI | HIGH-SPEED 3.3V 2K x 8 DUAL-PORT STATIC RAM WITH INTERRUPT |
相關代理商/技術參數 |
參數描述 |
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