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參數(shù)資料
| 型號： | IDT72T54252 |
| 廠商： | Integrated Device Technology, Inc. |
| 英文描述： | 2.5V QUAD/DUAL TeraSync⑩ DDR/SDR FIFO x10 QUAD FIFO or x10/x20 DUAL FIFO CONFIGURATIONS |
| 中文描述： | 2.5V的四/雙TeraSync⑩復(fù)員/特別提款權(quán)先進(jìn)先出× 10的四雙FIFO或x10/x20先進(jìn)先出配置 |
| 文件頁數(shù)： | 41/56頁 |
| 文件大?。?/td> | 555K |
| 代理商： | IDT72T54252 |
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41
COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
IDT72T54242/72T54252/72T54262 2.5V QUAD/DUAL TeraSync
DDR/SDR FIFO
32K x 10 x 4/16K x 20 x 2, 64K x 10 x 4/32K x 20 x 2 and 128K x 10 x 4/64K x 20 x 2
MARCH 22, 2005
Figure 18. Read Cycle, Output Enable and Empty Flag Timing (Quad mode, IDT Standard mode, SDR to SDR)
NOTES:
1. The timng diagramshown is for FIFO0. FIFO1-3 exhibits the same behavior.
2. t
SKEW1
is the mnimumtime between a rising WCLK0 edge and a rising RCLK0 edge to guarantee that
EF
0 will go HIGH (after one RCLK0 cycle plus t
REF
). If the time between
the rising edge of WCLK0 and the rising edge of RCLK0 is less than t
SKEW1
, then
EF
0 deassertion may be delayed one extra RCLK0 cycle. (See Table 6 - T
SKEW
measurement)..
3. First data word latency = t
SKEW1
+ 1*T
RCLK
+ t
REF.
4.
RCS
0
= LOW.
5. RCLK0 must be free running for
EF
0 to update.
6.
MD
IW
OW
WDDR
RDDR
FWFT/SI
1
D/C
D/C
0
0
0
6158 drw23
D[9:0]
t
DS
t
DH
W
X
W
X+1
t
DS
t
DH
NO OPERATION
RCLK0
REN
0
EF
0
t
CLK
t
CLKH
t
CLKL
t
ENH
t
REF
t
A
t
OLZ
Q[9:0]
OE
0
WCLK0
(2)
t
SKEW1
WEN
0
t
ENS
t
ENS
t
ENH
1
2
t
OE
NO OPERATION
t
ENS
t
ENH
t
OHZ
W
X-1
t
REF
t
ENH
t
ENS
t
A
t
A
t
REF
t
ENS
t
ENH
WCS
0
t
OE
t
ENS
t
ENH
W
X-1
W
X
W
X+1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| IDT72T54252L5BB | 2.5V QUAD/DUAL TeraSync⑩ DDR/SDR FIFO x10 QUAD FIFO or x10/x20 DUAL FIFO CONFIGURATIONS |
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參數(shù)描述 |
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| IDT72T54252L6-7BBI | 功能描述:IC FIFO DDR/SDR QUAD/DUAL 324BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標(biāo)準(zhǔn)包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應(yīng)商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱:74F433 |
| IDT72T54262L5BB | 功能描述:IC FIFO DDR/SDR QUAD/DUAL 324BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標(biāo)準(zhǔn)包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應(yīng)商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱:74F433 |
| IDT72T54262L5BBG | 功能描述:IC FIFO DDR/SDR QUAD/DUAL 324BGA RoHS:是 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標(biāo)準(zhǔn)包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應(yīng)商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱:74F433 |
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