參數(shù)資料
型號(hào)： IDT77301L12PFI
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： DRAM
英文描述： UTOPIAFIFO 1 TO 4 (128 x 9 x 4) DEMULTIPLEXER-FIFO
中文描述： 128 X 9 OTHER FIFO, 10 ns, PQFP100
封裝： TQFP-100
文件頁數(shù)： 7/29頁
文件大?。?/td> 342K
代理商： IDT77301L12PFI
7
IDT77301
UtopiaFIFO 1 to 4 (128 x 9 x 4) Demultiplexer-FIFO Commercial and Industrial Temperature Ranges
")&!"1!&!)&**
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23
564782
59 :9;.*&!",4
564782
59 69
NOTES:
1. Pulse widths less than mnimumvalues are not allowed.
2. Values guaranteed by design, not currently tested.
3. The IDT77301 timng specs are not equal to those of the IDT77305.
TX/RX
Commercial
Industrial
Mode
77301L12
77301L12
Symbol
Parameter
Mn.
Max.
Mn.
Max.
Unit
f
S
Clock Cycle Frequency
____
62.5
____
62.5
MHz
t
A
Data Access Time
2
10
2
10
ns
t
CLK
Clock Cycle Time
16
____
16
____
ns
t
CLKH
Clock High Time
7
____
7
____
ns
t
CLKL
Clock LowTime
7
____
7
____
ns
t
RS
Reset Pulse Width
(1)
12
____
12
____
ns
t
RSS
Reset Set-up Time
12
____
12
____
ns
t
RSR
Reset Recovery Time
10
____
10
____
ns
t
PRS
Reset to Output Time
____
8
____
8
ns
t
CLAVS
Cell Available Set-up Time, CLAVS to RCLK
4.5
____
6
____
ns
t
CLAVH
Cell Available Hold Time, RCLK to CLAVS
0
____
0
____
ns
t
ENRS
Enable Set-up Time,
to WCLK
5.5
____
6
____
ns
t
ENRH
Enable Hold Time, WCLK to
0
____
0
____
ns
t
ENSS
Enable Set-up Time,
to WCLK
4.5
____
4.5
____
ns
t
ENSH
Enable Hold Time, WCLK to
0
____
0
____
ns
t
SLES
Serial Load Set-up Time, SLE to SCLK
6
____
6
____
ns
t
SLEH
Serial Load Hold Time, SCLK to SLE
0
____
0
____
ns
t
ADRS
Address Set-up Time to WCLK
6
____
6.5
____
ns
t
ADRH
Address Hold Time, WCLK to Address
0
____
0
____
ns
t
SKEW1
Skew Time between RCLK and WCLK
(2)
11
____
11
____
ns
t
SKEW2
Skew Time between WCLK and RCLK
(2)
11
____
11
____
ns
t
DS
Data Set-up Time, Data to WCLK
5
____
5
____
ns
t
DH
Data Hold Time, WCLK to DATA
0
____
0
____
ns
t
SOCRS
SOCR Set-up Time, SOCR to WCLK
5.5
____
5.5
____
ns
t
SOCRH
SOCR Hold Time, WCLK to SOCR
0
____
0
____
ns
t
PSOC
RCLK to SOCS
____
10
____
10
ns
t
PCLAVR
WCLK to CLAVR
____
10
____
10
ns
t
PENS
RCLK to
____
10
____
10
ns
t
OE
to Qn Valid
1
10
1
10
ns
t
OHZ
to Qn in High Z
(2)
____
10
____
10
ns
t
OLZ
to Qn in LowZ
(2)
0
____
0
____
ns
3240 tbl 09
相關(guān)PDF資料
PDF描述
IDT77305 UTOPIAFIFO 4 PORT MULTIPLEXER FIFO
IDT77911 Octal Transceivers And Line/MOS Drivers With 3-State Outputs 20-PDIP -40 to 85
IDT77914 NICStAR⑩ Reference Design 155Mbps Network Interface Card NIC
IDT77915 NICStAR⑩ Reference Design 155Mbps Network Interface Card NIC
IDT77916 NICStAR Reference Design 25Mbps ATM Network Interface Card NIC with PCI interface and UTP3
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參數(shù)描述
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