參數(shù)資料
型號: IDTCV142PAG8
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 17/20頁
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描述: IC FLEXPC CLK PROGR P4 56-TSSOP
產(chǎn)品變化通告: Product Discontinuation 19/Jul/2010
標準包裝: 2,000
系列: FlexPC™
類型: PC 時鐘
PLL:
主要目的: Intel CPU 服務(wù)器,SATA CPU
輸入: 晶體
輸出: 時鐘
電路數(shù): 1
比率 - 輸入:輸出: 1:17
差分 - 輸入:輸出: 無/是
頻率 - 最大: 400MHz
電源電壓: 3.135 V ~ 3.465 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 56-TFSOP(0.240",6.10mm 寬)
供應(yīng)商設(shè)備封裝: 56-TSSOP
包裝: 帶卷 (TR)
其它名稱: CV142PAG8
COMMERCIALTEMPERATURERANGE
6
IDTCV142
PROGRAMMABLEFLEXPCCLOCKFORP4PROCESSOR
BYTE 1
Bit
Output(s) Affected
Description/Function
0
1
Type
Power On
0
CPU[2:0], SRC[7:0],
Spread Spectrum mode enable
Spreadoff
Spread on
RW
0
PCI[5:0], PCIF[1:0]
1
CPU0, CPU0#
OutputEnable
Tristate
Enable
RW
1
2
CPU1, CPU1#
OutputEnable
Tristate
Enable
RW
1
3
Reserved
RW
1
4
REF
OutputEnable
Tristate
Enable
RW
1
5
USB48
OutputEnable
Tristate
Enable
RW
1
6
DOT96
OutputEnable
Tristate
Enable
RW
1
7
PCIF0
OutputEnable
Tristate
Enable
RW
1
BYTE 2
Bit
Output(s) Affected
Description/Function
0
1
Type
Power On
0
PCIF1
OutputEnable
Tristate
Enable
RW
1
Reserved
RW
1
2
Reserved
RW
1
3
Reserved
RW
1
4
PCI0
OutputEnable
Tristate
Enable
RW
1
5
PCI1
OutputEnable
Tristate
Enable
RW
1
6
PCI2
OutputEnable
Tristate
Enable
RW
1
7
PCI3
OutputEnable
Tristate
Enable
RW
1
BYTE 4
Bit
Output(s) Affected
Description / Function
0
1
Type
Power On
0
CPU0, CPU0#
Allow control of CPU0
Notstopped
Stoppedwith
RW
1
with assertion of CPU_STOP#
by CPU_STOP#
CPU_STOP#
1
CPU1, CPU1#
Allow control of CPU1
Notstopped
Stoppedwith
RW
1
with assertion of CPU_STOP#
by CPU_STOP#
CPU_STOP#
2
CPU2, CPU2#
Allow control of CPU2
Notstopped
Stoppedwith
RW
1
with assertion of CPU_STOP#
by CPU_STOP#
CPU_STOP#
3
PCIF0
Allow controlled by
Notstopped
Stoppedwith
RW
0
4
PCIF1
PCI_STOP# assertion
by PCI_STOP#
PCI_STOP#
RW
0
5
Reserved
RW
0
6
DOT96
DOT96 power down drive mode
Driven in power down
Tristate
RW
0
7
Reserved
RW
0
BYTE 3
Bit
Output(s) Affected
Description / Function
0
1
Type
Power On
0
SRC0
RW
0
1
SRC1
RW
0
2
SRC2
Allow controlled by
Freerunning,not
Stoppedwith
RW
0
3
SRC3
PCI_STOP# assertion
affected by PCI_STOP#
PCI_STOP#
RW
0
4
SRC4
RW
0
5
SRC5
RW
0
6
Reserved
RW
0
7
SRC7
Allow controlled by
Freerunning,not
Stoppedwith
RW
0
PCI_STOP# assertion
affected by PCI_STOP#
PCI_STOP#
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PDF描述
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