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參數(shù)資料
| 型號： | IV80C52EXXX-L16SHXXX:D |
| 廠商： | ATMEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, PQFP44 |
| 封裝： | 1.40 MM HEIGHT, VQFP-44 |
| 文件頁數(shù)： | 164/395頁 |
| 文件大小： | 8161K |
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246
8018P–AVR–08/10
ATmega169P
23.5
LCD Register Description
23.5.1
LCDCRA – LCD Control and Status Register A
Bit 7 – LCDEN: LCD Enable
Writing this bit to one enables the LCD Controller/Driver. By writing it to zero, the LCD is turned
off immediately. Turning the LCD Controller/Driver off while driving a display, enables ordinary
port function, and DC voltage can be applied to the display if ports are configured as output. It is
recommended to drive output to ground if the LCD Controller/Driver is disabled to discharge the
display.
Bit 6 – LCDAB: LCD Low Power Waveform
When LCDAB is written logic zero, the default waveform is output on the LCD pins. When
LCDAB is written logic one, the Low Power Waveform is output on the LCD pins. If this bit is
modified during display operation the change takes place at the beginning of a new frame.
Bit 5 – Res: Reserved Bit
This bit is reserved and will always read as zero.
Bit 4 – LCDIF: LCD Interrupt Flag
This bit is set by hardware at the beginning of a new frame, at the same time as the display data
is updated. The LCD Start of Frame Interrupt is executed if the LCDIE bit and the I-bit in SREG
are set. LCDIF is cleared by hardware when executing the corresponding Interrupt Handling
Vector. Alternatively, writing a logical one to the flag clears LCDIF. Beware that if doing a Read-
Modify-Write on LCDCRA, a pending interrupt can be disabled. If Low Power Waveform is
selected the Interrupt Flag is set every second frame.
Bit 3 – LCDIE: LCD Interrupt Enable
When this bit is written to one and the I-bit in SREG is set, the LCD Start of Frame Interrupt is
enabled.
Bit 2 – LCDBD: LCD Buffer Disable
The intermediate voltage levels in the LCD are generated by an internal resistive voltage divider
and passed through buffer to increase the current driving capability. By writing this bit to one the
buffers are turned off and bypassed, resulting in decreased power consumption. The total resis-
tance of the voltage divider is nominally 400 k
Ω between LCDCAP and GND.
Bit 1 – LCDCCD: LCD Contrast Control Disable
Writing this bit to one disables the internal power supply for the LCD driver. The desired voltage
must be applied to the LCDCAP pin from an external power supply. To avoid conflict between
internal and external power supply, this bit must be written as '1' prior to or simultaneously with
writing '1' to the LCDEN bit.
Bit
7
6
5
4
3
2
1
0
(0xE4)
LCDEN
LCDAB
–
LCDIF
LCDIE
LCDBD
LCDCCD
LCDBL
LCDCRA
Read/Write
R/W
R
R/W
Initial Value
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| R80C154-30R | 8-BIT, 30 MHz, MICROCONTROLLER, CQCC44 |
| MR83C154XXX-16P883 | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CQCC44 |
| MQ83C154CXXX-16P883 | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CQFP44 |
| MD83C154XXX-20P883D | 8-BIT, MROM, 20 MHz, MICROCONTROLLER, CDIP40 |
| MR80C154-25P883D | 8-BIT, 25 MHz, MICROCONTROLLER, CQCC44 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| IV-811MX | 制造商:Digital ID View 功能描述:8 CH H.264 DVR USB REMOTENO HDD 制造商:DIGITAL IDVIEW 功能描述:8 CH H.264 DVR USB REMOTE NO HDD |
| IV-811Z-960H-1000 | 制造商:Digital ID View 功能描述:8-Channel 960H i-Cloud Series DVR with 1TB HDD |
| IV-811Z-960H-500 | 制造商:Digital ID View 功能描述:8-Channel 960H i-Cloud Series DVR with 500GB HDD 制造商:DIGITAL IDVIEW 功能描述:8-CHNL ICLOUD 960H DVR 500GB HDD HDMI OUT |
| IV-811ZAECO-1000 | 制造商:Digital ID View 功能描述:8 Ch H.264 DVR D1 1Tbb Dvd |
| IV-811ZAECO-500 | 制造商:Digital ID View 功能描述:8 Ch H.264 DVR D1 500GB Dvd |
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