參數資料
| 型號： | KSZ8841-16MQL A6 |
| 廠商： | Micrel Inc |
| 文件頁數： | 64/105頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MAC CTRLR 8/16BIT 128-PQFP |
| 標準包裝： | 66 |
| 控制器類型： | 以太網控制器，MAC |
| 接口： | 總線 |
| 電源電壓： | 3.1 V ~ 3.5 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 128-BFQFP |
| 供應商設備封裝： | 128-PQFP（14x20） |
| 包裝： | 托盤 |
| 配用： | 576-1631-ND - BOARD EVALUATION KSZ8841-16MQL |
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Micrel, Inc.
KSZ8841-16/32 MQL/MVL/MBL
October 2007
61
M9999-102207-1.6
Bank 6 Wakeup Frame 2 Byte Mask 1 Register (0x06): WF2BM1
This register contains the next 16 bytes mask values of the Wake up frame 2 pattern. Setting bit 0 selects the 17th byte
of the Wake up frame 2. Setting bit 15 selects the 32nd byte of the Wake up frame 2.
Bit
Default Value
R/W
Description
15-0
0
RW
WF2BM1
Wake-up frame 2 Byte Mask 1.
The next 16 bytes mask covering bytes 17 to 32 of a Wake-up frame 2 pattern.
Bank 6 Wakeup Frame 2 Byte Mask 2 Register (0x08): WF2BM2
This register contains the next 16 bytes mask values of the Wake up frame 2 pattern. Setting bit 0 selects the 33rd byte
of the Wake up frame 2. Setting bit 15 selects the 48th byte of the Wake up frame 2.
Bit
Default Value
R/W
Description
15-0
0
RW
WF2BM2
Wake-up frame 2 Byte Mask 2.
The next 16 bytes mask covering bytes 33 to 48 of a Wake-up frame 2 pattern.
Bank 6 Wakeup Frame 2 Byte Mask 3 Register (0x0A): WF2BM3
This register contains the last 16 bytes mask values of the Wake up frame 2 pattern. Setting bit 0 selects the 49th byte
of the Wake up frame 2. Setting bit 15 selects the 64th byte of the Wake up frame 2.
Bit
Default Value
R/W
Description
15-0
0
RW
WF2BM3
Wake-up frame 2 Byte Mask 3.
The last 16 bytes mask covering bytes 49 to 64 of a Wake-up frame 2 pattern.
Bank 7 Wakeup Frame 3 CRC0 Register (0x00): WF3CRC0
This register contains the expected CRC values of the Wake up frame 3 pattern.
The value of the CRC calculated is based on the IEEE 802.3 Ethernet standard, it is taken over the bytes specified in
the wake-up byte mask registers.
Bit
Default Value
R/W
Description
15-0
0
RW
WF3CRC0
Wake-up frame 3 CRC (lower 16 bits).
The expected CRC value of a Wake up frame 3pattern.
Bank 7 Wakeup Frame 3 CRC1 Register (0x02): WF3CRC1
This register contains the expected CRC values of the Wake up frame 3 pattern.
The value of the CRC calculated is based on the IEEE 802.3 Ethernet standard, it is taken over the bytes specified in
the wake up byte mask registers.
Bit
Default Value
R/W
Description
15-0
0
RW
WF3CRC1
Wake-up frame 3 CRC (upper 16 bits).
The expected CRC value of a Wake up frame 3 pattern.
相關PDF資料 |
PDF描述 |
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