- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377598 > L64364 (LSI Corporation) Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) PDF資料下載
參數(shù)資料
| 型號： | L64364 |
| 廠商： | LSI Corporation |
| 英文描述： | Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) |
| 中文描述： | 高度集成的自動柜員機分段和重組（SAR）的網(wǎng)絡(luò)應(yīng)用（用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片優(yōu)化引擎） |
| 文件頁數(shù)： | 310/444頁 |
| 文件大?。?/td> | 3267K |
| 代理商： | L64364 |
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9-14
PCI Interface
BA2[31:24]
Base Address 2
BA2[31
:
24]
specifies the PCI Base Address for local
memory connected to the ATMizer’s Secondary Bus.
From 16 Mbytes to 64 Mbytes of local memory is acces-
sible by the PCI Bus under control of the
SB_64M
bit in
the SP_Ctrl register (
page 10-5
).
[31:24]
When
SB_64M
is cleared, a 16 Mbyte local memory map
is selected and
BA2[31:24]
define the PCI Base
Address. If
SB_64M
is set, a 64 Mbyte local memory map
is selected and
BA2[31:26]
define the PCI Base
Address.
SB_64M
should be programmed before Base
Address register 2 is accessed.
R
Reserved
Not used in the L64364.
[23:4]
PF2
Prefetchable
The L64364 allows multiple-word bursts from local mem-
ory. The
PF2
bit is hardwired to 1, enabling local memory
to be prefetchable.
3
Note:
Read accesses to the Secondary Bus prefetch the number
of words specified in the PP_SlavePFtch register. See
Sec-
tion 9.3.3, “Primary Port Slave Prefetch Register.”
TYPE[1:0]
Base Address Type
TYPE[1
:
0]
is hardwired to 0x0, indicating that Base
Address register 2 can be located anywhere in the
32-bit PCI memory space.
[2:1]
MSI
Memory Space Identifier
MSI
is hardwired to 0, indicating that Base Address 2 is
in Memory Space rather than I/O Space.
0
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