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參數(shù)資料
| 型號： | M1AFS250-FPQ208 |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 250000 GATES, PQFP208 |
| 封裝： | 0.50 MM PITCH, PQFP-208 |
| 文件頁數(shù)： | 166/318頁 |
| 文件大?。?/td> | 10129K |
| 代理商： | M1AFS250-FPQ208 |
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Device Architecture
2- 232
Pr el iminar y v1 .7
Advance v0.7
(continued)
section were updated to add information about maximum differential voltage.
Supply Voltage" section were updated.
The "VCCPLA/B PLL Supply Voltage" section was updated to include information
about the east and west PLLs.
The VCOMPLF pin description was deleted.
N/A
The "Axy Analog Input/Output" section was updated with information about
grounding and floating the pin.
The voltage range in the "VPUMP Programming Supply Voltage" section was
updated. The parenthetical reference to "pulled up" was removed from the
statement, "
VPUMP can be left floating or can be tied (pulled up) to any
voltage between 0 V and 3.6 V."
The "ATRTNx Temperature Monitor Return" section was updated with
information about grounding and floating the pin.
The following text was deleted from the "VREF I/O Voltage Reference" section:
(all digital I/O).
were updated to include information about the type of capacitor that is
required to connect the two.
1 F was changed to 100 pF in the "XTAL1 Crystal Oscillator Circuit Input".
Advance v0.5
(June 2006)
The second paragraph of the "PLL Macro" section was updated to include
information about POWERDOWN.
The description for bit 0 was updated in Table 2-17 RTC Control/Status
3.9 was changed to 7.8 in the "Crystal Oscillator (Xtal Osc)" section.
All function descriptions in Table 2-18 Signals for VRPSM Macro.
In Table 2-19 Flash Memory Block Pin Names, the RD[31:0] description was
updated.
The "RESET" section was updated.
The "RESET" section was updated.
Table2-35FIFO was updated.
The VAREF function description was updated in Table2-36Analog Block Pin
The "Voltage Monitor" section was updated to include information about low
power mode and sleep mode.
The text in the "Current Monitor" section was changed from 2 mV to 1 mV.
The "Gate Driver" section was updated to include information about forcing 1
V on the drain.
The "Analog-to-Digital Converter Block" section was updated with the
following statement:
"All results are MSB justified in the ADC."
Previous Version
Changes in Current Version (Preliminary v1.7)
Page
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| M1AFS250-FPQG208 | FPGA, 250000 GATES, PQFP208 |
| M1AFS250-FQN180 | FPGA, 250000 GATES, PBCC180 |
| M1AFS250-FQNG180 | FPGA, 250000 GATES, PBCC180 |
| M20-1051700 | 34 CONTACT(S), FEMALE, TWO PART BOARD CONNECTOR, CRIMP, SOCKET |
| M20-1051800 | 36 CONTACT(S), FEMALE, TWO PART BOARD CONNECTOR, CRIMP, SOCKET |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| M1AFS250-FPQ256ES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
| M1AFS250-FPQ256I | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
| M1AFS250-FPQ256PP | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
| M1AFS250-FPQG208 | 制造商:Microsemi Corporation 功能描述:FPGA FUSION 250K GATES 130NM 1.5V 208PQFP - Trays |
| M1AFS250-FPQG256ES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
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