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參數(shù)資料

型號：	M38C37ECAFP
元件分類：	微控制器/微處理器
英文描述：	8-BIT, OTPROM, 8 MHz, MICROCONTROLLER, PQFP80
封裝：	14 X 20 MM, 0.80 MM PITCH, PLASTIC, QFP-80
文件頁數(shù)：	2/223頁
文件大小：	1698K
代理商：	M38C37ECAFP

第1頁當前第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁

38C3 Group User’s Manual

List of figures

Fig. 48 Time up to execution of interrupt processing routine ............................................... 1-47

Fig. 49 A-D conversion equivalent circuit ................................................................................. 1-49

Fig. 50 A-D conversion timing chart .......................................................................................... 1-49

CHAPTER 2 APPLICATION

Fig. 2.1.1 Memory map of I/O port relevant registers .............................................................. 2-2

Fig. 2.1.2 Structure of port Pi (i = 0, 1, 2, 3, 4, 5, 6, 8) ........................................................ 2-3

Fig. 2.1.3 Structure of port P7 ..................................................................................................... 2-3

Fig. 2.1.4 Structure of Port P0 direction register and port P1 direction register ................. 2-4

Fig. 2.1.5 Structure of Port Pi direction register (i = 2, 4, 5, 6, 8) ....................................... 2-4

Fig. 2.1.6 Structure of Port P7 direction register ...................................................................... 2-5

Fig. 2.1.7 Structure of PULL register A ...................................................................................... 2-5

Fig. 2.1.8 Structure of PULL register B ...................................................................................... 2-6

Fig. 2.1.9 Structure of Port P8 output selection register ......................................................... 2-6

Fig. 2.2.1 Memory map of registers relevant to timers .......................................................... 2-10

Fig. 2.2.2 Structure of Timer i (i=1, 3, 4, 5, 6) ....................................................................... 2-11

Fig. 2.2.3 Structure of Timer 2 .................................................................................................. 2-11

Fig. 2.2.4 Structure of Timer 6 PWM register ......................................................................... 2-12

Fig. 2.2.5 Structure of Timer 12 mode register ....................................................................... 2-12

Fig. 2.2.6 Structure of Timer 34 mode register ....................................................................... 2-13

Fig. 2.2.7 Structure of Timer 56 mode register ....................................................................... 2-13

Fig. 2.2.8 Structure of Timer A register (low-order, high-order) ........................................... 2-14

Fig. 2.2.9 Structure of Compare register (low-order, high-order) .......................................... 2-14

Fig. 2.2.10 Structure of Timer A mode register ...................................................................... 2-15

Fig. 2.2.11 Structure of Timer A control register .................................................................... 2-15

Fig. 2.2.12 Structure of Interrupt request register 1 ............................................................... 2-16

Fig. 2.2.13 Structure of Interrupt request register 2 ............................................................... 2-17

Fig. 2.2.14 Structure of Interrupt control register 1 ................................................................ 2-18

Fig. 2.2.15 Structure of Interrupt control register 2 ................................................................ 2-18

Fig. 2.2.16 Timers connection and setting of division ratios ................................................. 2-20

Fig. 2.2.17 Relevant registers setting ....................................................................................... 2-21

Fig. 2.2.18 Control procedure ..................................................................................................... 2-22

Fig. 2.2.19 Peripheral circuit example ....................................................................................... 2-23

Fig. 2.2.20 Timers connection and setting of division ratios ................................................. 2-23

Fig. 2.2.21 Relevant registers setting ....................................................................................... 2-24

Fig. 2.2.22 Control procedure ..................................................................................................... 2-24

Fig. 2.2.23 Judgment method of valid/invalid of input pulses ............................................... 2-25

Fig. 2.2.24 Relevant registers setting ....................................................................................... 2-26

Fig. 2.2.25 Control procedure ..................................................................................................... 2-27

Fig. 2.2.26 Timers connection and setting of division ratios ................................................. 2-28

Fig. 2.2.27 Relevant registers setting ....................................................................................... 2-29

Fig. 2.2.28 Control procedure ..................................................................................................... 2-30

Fig. 2.2.29 PWM output and IGBT output (1) ......................................................................... 2-31

Fig. 2.2.30 PWM output and IGBT output (2) ......................................................................... 2-31

Fig. 2.2.31 PWM output and IGBT output (3) ......................................................................... 2-32

Fig. 2.3.1 Memory map of registers relevant to Serial I/O .................................................... 2-33

Fig. 2.3.2 Structure of Serial I/O control register 1 ................................................................ 2-33

Fig. 2.3.3 Structure of Serial I/O control register 2 ................................................................ 2-34

Fig. 2.3.4 Structure of Interrupt request register 1 ................................................................. 2-34

Fig. 2.3.5 Structure of Interrupt control register 1 .................................................................. 2-35

Fig. 2.3.6 Serial I/O connection examples (1) ......................................................................... 2-36

Fig. 2.3.7 Serial I/O connection examples (2) ......................................................................... 2-37

相關(guān)PDF資料	PDF描述
M38C37ECMFP	8-BIT, OTPROM, 4 MHz, MICROCONTROLLER, PQFP80
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