參數(shù)資料
型號(hào)： M4A3-192/96-6FAC
廠商： Lattice Semiconductor Corporation
文件頁(yè)數(shù)： 10/62頁(yè)
文件大?。?/td> 0K
描述： IC CPLD ISP 4A 192MC 144FPBGA
標(biāo)準(zhǔn)包裝： 160
系列： ispMACH® 4A
可編程類型： 系統(tǒng)內(nèi)可編程
最大延遲時(shí)間 tpd(1)： 6.0ns
電壓電源 - 內(nèi)部： 3 V ~ 3.6 V
宏單元數(shù)： 192
輸入/輸出數(shù)： 96
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 144-BGA
供應(yīng)商設(shè)備封裝： 144-FPBGA（13x13）
包裝： 托盤(pán)
18
ispMACH 4A Family
Input Switch Matrix
The input switch matrix (Figures 12 and 13) optimizes routing of inputs to the central switch matrix.
Without the input switch matrix, each input and feedback signal has only one way to enter the central switch
matrix. The input switch matrix provides additional ways for these signals to enter the central switch matrix.
To
Central
Switch
Matrix
From
Macrocell
2
From Input Cell
Direct
From
Macrocell
1
Registered/Latched
17466G-002
17466G-003
Figure 12. ispMACH 4A with 2:1 Macrocell-I/O Cell
Ratio - Input Switch Matrix
Figure 13. ispMACH 4A with 1:1 Macrocell-I/O Cell
Ratio - Input Switch Matrix
To
Central
Switch
Matrix
From
Macrocell
From
I/O
Pin
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PDF描述
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