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參數(shù)資料
| 型號： | MACH210A-10VC |
| 廠商： | LATTICE SEMICONDUCTOR CORP |
| 元件分類： | PLD |
| 英文描述： | High-Density EE CMOS Programmable Logic |
| 中文描述： | EE PLD, 10 ns, PQFP44 |
| 封裝： | TQFP-44 |
| 文件頁數(shù)： | 31/47頁 |
| 文件大?。?/td> | 347K |
| 代理商： | MACH210A-10VC |
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MACH210-7/10/12/15/20, Q-12/15/20
SWITCHING WAVEFORMS
Notes:
1. VT = 1.5 V.
2. Input pulse amplitude 0 V to 3.0 V.
3. Input rise and fall times 2 ns–4 ns typical.
tPD
Input, I/O, or
Feedback
Combinatorial
Output
VT
Combinatorial Output
VT
Input, I/O,
or Feed-
back
Registered
Output
Registered Output
tS
tCO
VT
tH
VT
Clock
tWH
Clock
Clock Width
tWL
VT
Combinatorial
Output
Registered Input (MACH 2 and 4)
tSIR
tICO
VT
tHIR
VT
Input
Register
Clock
Registered
Input
Latched Output (MACH 2, 3, and 4)
Gate
Gate Width (MACH 2, 3, and 4)
tGWS
VT
tICS
Input Register to Output Register Setup
(MACH 2 and 4)
Output
Register
Clock
Input
Register
Clock
Registered
Input
tPDL
Input, I/O, or
Feedback
Latched
Out
Gate
VT
tHL
tSL
tGO
VT
14128I-9
14128I-10
14128I-11
14128I-12
14128I-13
14128I-14
14128I-15
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MACH210A-12JC | High-Density EE CMOS Programmable Logic |
| MACH210A-12VC | High-Density EE CMOS Programmable Logic |
| MACH210A-7 | High-Density EE CMOS Programmable Logic |
| MACH215-12JC | High-Density EE CMOS Programmable Logic |
| MACH215-15JC | High-Density EE CMOS Programmable Logic |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MACH210A-12 | 制造商:AMD 制造商全稱:Advanced Micro Devices 功能描述:High-Density EE CMOS Programmable Logic |
| MACH210A-12JC | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:High-Density EE CMOS Programmable Logic |
| MACH210A-12JI | 制造商:AMD 制造商全稱:Advanced Micro Devices 功能描述:High-Density EE CMOS Programmable Logic |
| MACH210A-12VC | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:High-Density EE CMOS Programmable Logic |
| MACH210A-14JI | 制造商:AMD 制造商全稱:Advanced Micro Devices 功能描述:High-Density EE CMOS Programmable Logic |
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