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參數(shù)資料
| 型號： | MB8116160A-60 |
| 廠商： | Fujitsu Limited |
| 英文描述： | CMOS 1 M ×16 BIT Fast Page Mode DRAM(CMOS 1 M ×16 位快速頁面存取模式動態(tài)RAM) |
| 中文描述： | 的CMOS 1米× 16位快速頁面模式的DRAM的CMOS（1米× 16位快速頁面存取模式動態(tài)內(nèi)存） |
| 文件頁數(shù)： | 20/25頁 |
| 文件大?。?/td> | 330K |
| 代理商： | MB8116160A-60 |
20
MB8116160A-60/MB8116160A-70
A
0
to A
11
V
IH
V
IL
V
OH
V
OL
RAS
V
IH
V
IL
DQ
(Output)
Fig. 15 – HIDDEN REFRESH CYCLE
DESCRIPTION
A hidden refresh cycle may be performed while maintaining the latest valid data at the output by extending the active time of LCAS
or UCAS and cycling RAS. The refresh row address is provided by the on-chip refresh address counter. This eliminates the need
for the external row address that is required by DRAMs that do not have CAS-before-RAS refresh capability.
WE
V
IH
V
IL
OE
V
IH
V
IL
V
IH
V
IL
DQ
(Input)
t
RC
t
RC
t
RAS
t
RP
t
RAS
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OEL
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CRP
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CHR
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RSH
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DZO
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OEZ
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OED
t
OFF
t
OH
HIGH-Z
VALID DATA OUT
“H” or “L”
ROW
ADDRESS
COLUMN
ADDRESS
HIGH-Z
LCAS
or
UCAS
V
IH
V
IL
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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