參數(shù)資料
型號： MB81V4400C-70
廠商： Fujitsu Limited
英文描述： CMOS 1M x 4 Bit Fast Page Mode Dynamic RAM(CMOS 1M x 4位快速頁模式動態(tài)RAM)
中文描述： 100萬的CMOS × 4位快速頁面模式動態(tài)RAM的CMOS（100萬× 4位快速頁模式動態(tài)內(nèi)存）
文件頁數(shù)： 13/26頁
文件大小： 302K
代理商： MB81V4400C-70
13
MB81V4400C-60/MB81V4400C-70
VALID
DATA IN
COL
ADD
ROW
ADD
HIGH-Z
HIGH-Z
HIGH-Z
Fig. 7 – OE (DELAYED WRITE CYCLE)
“H” or “L”
Invalid Data
DESCRIPTION
In the OE (delayed write) cycle, tWCS is not satisfied ; thus, the data on the DQ pins is latched with the falling edge of WE and
written into memory. The Output Enable (OE) signal must be changed from Low to High before WE goes Low (t
OED
+ t
T
+ t
DS
).
t
RC
t
RP
t
CSH
t
RCD
t
CRP
t
RSH
t
CAS
t
CWL
t
RAD
t
RAH
t
DZC
t
WP
t
DS
t
DH
t
AA
t
RAC
t
ASR
t
WCH
t
OED
t
CAC
t
OEH
t
ASC
t
CAH
t
RWL
t
RAL
RAS
V
IH
V
IL
V
IH
V
IL
V
IH
V
IL
V
IH
V
IL
V
OH
V
OL
CAS
WE
DQ
(Output)
A
0
to A
9
DQ
(Input)
V
IH
V
IL
OE
V
IH
V
IL
t
CAL
t
OEZ
t
OEA
t
DZO
t
RAS
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PDF描述
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