參數(shù)資料
型號(hào): MB89P195AP-201
元件分類: 微控制器/微處理器
英文描述: 8-BIT, OTPROM, 4.2 MHz, MICROCONTROLLER, PDIP28
封裝: 0.600 INCH, 0.100 INCH PITCH, PLASTIC, DIP-28
文件頁數(shù): 69/256頁
文件大?。?/td> 1811K
代理商: MB89P195AP-201
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8-12 Chapter 8 8-bit Serial I/O
MB89190/190A series
8.
5 Interrupt for 8-bit Serial I/O
The interrupt factor for the 8-bit serial I/O is the completion of the 8-bit data serial
I/O.
T Interrupt during serial I/O
The 8-bit serial I/O performs serial output and input at the same time. When serial transfer is started, the
value of the serial data register (SDR) is input/output bit-by-bit in synchronization with the set shift clock
cycle. Then, when the shift clock for the eighth bit is rising, the interrupt request flag bit (SMR: SIOF) is
set to 1. At this point, when the interrupt request output enable bit is already enabled (SMR: SIOE = 1),
the interrupt request (IRQ8) to the CPU is generated.
Write 0 to the SIOF bit using the interrupt
processing routine to clear the interrupt request. The SIOF bit is set irrespective of the value of the SIOE
bit when 8-bit serial output is completed.
Remark:
When serial transfer stop (SMR: SST = 0) and serial data transfer completion occur at the
same time during serial I/O, the interrupt request flag bit is not set (SMR: SIOF = 1). Also, an
interrupt request is generated when the SIOE bit is changed from Disable to Enable (0
→ 1)
when the SIOF bit is 1.
T Register and vector table related to interrupt for 8-bit serial I/O
Table 8-5 Register and Vector Table Related to Interrupt for 8-bit Serial I/O
Interrupt level setting register
Address of the vector table
Interrupt
name
Register
Bit to set
Higher order
Lower order
IRQ8
ILR3 (007EH)
L80 (bit 1)
L81 (bit 0)
FFEAH
FFEBH
Reference: For the interrupt operation, see
Section 3.4.2.
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PDF描述
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