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參數(shù)資料
| 型號(hào)： | MB89PV980-101 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, 4.2 MHz, MICROCONTROLLER, CQFP64 |
| 封裝： | 1 MM PITCH, CERAMIC, PIGGY BACK, MQFP-64 |
| 文件頁(yè)數(shù)： | 186/426頁(yè) |
| 文件大小： | 2051K |
| 代理商： | MB89PV980-101 |
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262
CHAPTER 9 EXTERNAL INTERRUPT CIRCUIT 1 (EDGE)
9.4
External Interrupt Circuit 1 Interrupts
The external interrupt circuit 1 can generate interrupt requests when it detects a
specified edge on the signal input to an external interrupt pin.
s Interrupts for External Interrupt Circuit 1 Operation
If external interrupts are enabled (EIE1: IE10 to IE30 = 1) and the specified edge is detected at
the external interrupt input, the corresponding external IRQ flag bit (EIF1: IF10 to IF13) is set to
"1" and the corresponding IRQ (IRQ0 to IRQ3) sent to the CPU. Write "0" to the corresponding
external interrupt request flag bit in the interrupt processing routine to clear the interrupt request.
Check:
When enabling interrupts (EIE1: IE10 to IE13 = "1") after wake-up from a reset, always clear
the corresponding external interrupt request flag bit (EIE1: IF10 to IF13 = "0") in advance.
Also, interrupt processing cannot return if the external interrupt request flag bit is "1" and the
interrupt request enable bit is enabled. In the interrupt processing routine, always clear the
external interrupt request flag bit.
Notes:
Changing a signal inversion bit from the "non-invert" to the "invert" state while the INT pin is
"H", or from "invert" to "non-invert" while the pin is LOW, will cause the external interrupt
request flag bit (EIF1: IF10 to IF13) to be set immediately. Changing an external interrupt bit
from "disable" to "enable" (EIE1: IE10 to IE13: 0 --> 1) may also set the external IRQ flag bit.
For this reason, you should make the inversion or enable bit changes with interrupts in the
disabled state, then clear IRQ flags before enabling interrupts again.
An interrupt request is generated immediately if the external interrupt request flag bit is "1"
when the external interrupt enable bit is changed from disabled to enabled ("0" --> "1").
Wake-up from stop mode by an interrupt is possible using only the external interrupt circuit 1
and 2.
Perform with interrupts disabled, then clear external IRQ flags before enabling interrupts.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MB89PV980-201 | 8-BIT, 4.2 MHz, MICROCONTROLLER, CQFP64 |
| MB89P985PFV-101 | 8-BIT, OTPROM, 4.2 MHz, MICROCONTROLLER, PQFP64 |
| MB89983-XXX-PFM | 8-BIT, MROM, 4.2 MHz, MICROCONTROLLER, PQFP64 |
| MB89P985PFM-201 | 8-BIT, OTPROM, 4.2 MHz, MICROCONTROLLER, PQFP64 |
| MB89PV930ACF | 8-BIT, 10 MHz, MICROCONTROLLER, CQFP48 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MB89PV980-201 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:8-bit Proprietary Microcontroller |
| MB89PW625 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:8-bit Proprietary Microcontroller |
| MB89R112B1QN-G-AMERE1 | 制造商:FUJITSU 功能描述: |
| MB89R112B2QN-G-AMERE1 | 制造商:FUJITSU 功能描述: |
| MB89T637R-101P-G-SH | 制造商:FUJITSU 功能描述: |
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