參數(shù)資料
型號(hào)： MC3S12XEP100J1VAAR
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP80
封裝： PLASTIC, QFP-80
文件頁數(shù)： 852/1324頁
文件大?。?/td> 8453K
代理商： MC3S12XEP100J1VAAR
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Chapter 14 Enhanced Capture Timer (ECT16B8CV3)
MC9S12XE-Family Reference Manual Rev. 1.21
Freescale Semiconductor
573
Because of an order from the United States International Trade Commission, BGA-packaged product lines and partnumbers
indicated here currently are not available from Freescale for import or sale in the United States prior to September 2010
At the same time the pulse accumulator is cleared.
14.4.1.4
Modulus Down-Counter
The modulus down-counter can be used as a time base to generate a periodic interrupt. It can also be used
to latch the values of the IC registers and the pulse accumulators to their holding registers.
The action of latching can be programmed to be periodic or only once.
14.4.1.5
Precision Timer
By enabling the PRNT bit of the TSCR1 register, the performance of the timer can be enhanced. In this
case, it is possible to set additional prescaler settings for the main timer counter and modulus down counter
and enhance delay counter settings compared to the settings in the present ECT timer.
14.4.1.6
Flag Clearing Mechanisms
The ags in the ECT can be cleared one of two ways:
1. Normal ag clearing mechanism (TFFCA = 0)
Any of the ECT ags can be cleared by writing a one to the ag.
2. Fast ag clearing mechanism (TFFCA = 1)
With the timer fast ag clear all (TFFCA) enabled, the ECT ags can only be cleared by accessing
the various registers associated with the ECT modes of operation as described below. The ags
cannot be cleared via the normal ag clearing mechanism. This fast ag clearing mechanism has
the advantage of eliminating the software overhead required by a separate clear sequence. Extra
care must be taken to avoid accidental ag clearing due to unintended accesses.
— Input capture
A read from an input capture channel register causes the corresponding channel ag, CxF, to
be cleared in the TFLG1 register.
— Output compare
A write to the output compare channel register causes the corresponding channel flag, CxF, to
be cleared in the TFLG1 register.
— Timer counter
Any access to the TCNT register clears the TOF flag in the TFLG2 register.
— Pulse accumulator A
Any access to the PACN3 and PACN2 registers clears the PAOVF and PAIF flags in the
PAFLG register.
— Pulse accumulator B
Any access to the PACN1 and PACN0 registers clears the PBOVF flag in the PBFLG register.
— Modulus down counter
Any access to the MCCNT register clears the MCZF flag in the MCFLG register.
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