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參數(shù)資料
| 型號： | MC56F8036VLF |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 14/164頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DGTL SGNL CTLR 16BIT 48-LQFP |
| 標(biāo)準(zhǔn)包裝： | 1,250 |
| 系列： | 56F8xxx |
| 核心處理器： | 56800E |
| 芯體尺寸： | 16-位 |
| 速度： | 32MHz |
| 連通性： | CAN，I²C，SCI，SPI |
| 外圍設(shè)備： | POR，PWM，WDT |
| 輸入/輸出數(shù)： | 39 |
| 程序存儲器容量： | 64KB（32K x 16） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 4K x 16 |
| 電壓 - 電源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 10x12b; D/A 2x12b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 105°C |
| 封裝/外殼： | 48-LQFP |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 734 (CN2011-ZH PDF) |
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56F8036 Data Sheet, Rev. 6
110
Freescale Semiconductor
Figure 6-28 Sources of RESET Functional Diagram (Test modes not included)
POR resets are extended 64 OSC_CLK clocks to stabilize the power supply and clock source. All resets
are subsequently extended for an additional 32 OSC_CLK clocks and 64 system clocks as the various
internal reset controls are released. Given the normal relaxation oscillator rate of 8MHz, the duration of a
POR reset from when power comes on to when code is running is 28S. An external reset generation
circuit may also be used. A description of how these resets are used to initialize the clocking system and
system modules is included in Section 6.7.
6.7 Clocks
The memory, peripheral and core clocks all operate at the same frequency (32MHz maximum) with the
exception of the peripheral clocks for quad timers TMRA and TMRB and the PWM, which have the option
to operate at 3X system clock. The SIM is responsible for clock distributions.
While the SIM generates the ADC peripheral clock in the same way it generates all other peripheral clocks,
the ADC standby and conversion clocks are generated by a direct interface between the ADC and the
OCCS module.
EXTENDED_POR
JTAG
Memory
Subsystem
Peripherals
56800E
CORE_RST
Delay 32
sys clocks
OCCS
CLKGEN_RST
PERIP_RST
Delay 32
sys clocks
pulse shaper
SW Reset
pulse shaper
Delay 32
OSC_CLK
Clock
pulse shaper
POR
Power-On
Reset
(active low)
External
RESET IN
(active low)
RESET
Delay 64
OSC_CLK
Clock
Delay blocks assert immediately and
deassert only after the programmed
number of clock cycles.
COMBINED_RST
COP_LOR
(active low)
COP_TOR
(active low)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC56F8037VLH | IC DSP 16BIT DUAL 64-LQFP |
| MC56F8135VFGE | IC DIGITAL SIGNAL CTLR 128-LQFP |
| MC56F8147VPYE | IC DSP 16BIT 40MHZ 160-LQFP |
| MC56F8155VFGE | IC DSP 16BIT 40MHZ 128-LQFP |
| MC56F8156VFVE | IC DSP 16BIT 40MHZ 144-LQFP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC56F8036VLF | 制造商:Freescale Semiconductor 功能描述:IC DSC 64KB 32MHZ 3.6V LQFP-48 |
| MC56F8037 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:16-bit Digital Signal Controllers |
| MC56F8037EVM | 功能描述:開發(fā)板和工具包 - 其他處理器 MC56F8037 EVAL BOARD RoHS:否 制造商:Freescale Semiconductor 產(chǎn)品:Development Systems 工具用于評估:P3041 核心:e500mc 接口類型:I2C, SPI, USB 工作電源電壓: |
| MC56F8037EVM | 制造商:Freescale Semiconductor 功能描述:MC56F8037 EVALUATION BRD |
| MC56F8037MLH | 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC 16 BIT DSPHC RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT |
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