參數(shù)資料
型號： MC56F8335MFGE
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 數(shù)字信號處理
英文描述： 4-BIT, 120 MHz, OTHER DSP, PQFP128
封裝： ROHS COMPLIANT, PLASTIC, LQFP-128
文件頁數(shù)： 125/164頁
文件大?。?/td> 871K
代理商： MC56F8335MFGE
Peripheral Memory Mapped Registers
56F8335 Technical Data, Rev. 5
Freescale Semiconductor
63
Preliminary
Table 4-32 GPIOD Registers Address Map
(GPIOD_BASE = $00 F320)
Register Acronym
Address Offset
Register Description
Reset Value
GPIOD_PUR
$0
Pull-up Enable Register
0 x 1FFF
GPIOD_DR
$1
Data Register
0 x 0000
GPIOD_DDR
$2
Data Direction Register
0 x 0000
GPIOD_PER
$3
Peripheral Enable Register
0 x 1FC0
GPIOD_IAR
$4
Interrupt Assert Register
0 x 0000
GPIOD_IENR
$5
Interrupt Enable Register
0 x 0000
GPIOD_IPOLR
$6
Interrupt Polarity Register
0 x 0000
GPIOD_IPR
$7
Interrupt Pending Register
0 x 0000
GPIOD_IESR
$8
Interrupt Edge-Sensitive Register
0 x 0000
GPIOD_PPMODE
$9
Push-Pull Mode Register
0 x 1FFF
GPIOD_RAWDATA
$A
Raw Data Input Register
—
Table 4-33 GPIOE Registers Address Map
(GPIOE_BASE = $00 F330)
Register Acronym
Address Offset
Register Description
Reset Value
GPIOE_PUR
$0
Pull-up Enable Register
0 x 3FFF
GPIOE_DR
$1
Data Register
0 x 0000
GPIOE_DDR
$2
Data Direction Register
0 x 0000
GPIOE_PER
$3
Peripheral Enable Register
0 x 3FFF
GPIOE_IAR
$4
Interrupt Assert Register
0 x 0000
GPIOE_IENR
$5
Interrupt Enable Register
0 x 0000
GPIOE_IPOLR
$6
Interrupt Polarity Register
0 x 0000
GPIOE_IPR
$7
Interrupt Pending Register
0 x 0000
GPIOE_IESR
$8
Interrupt Edge-Sensitive Register
0 x 0000
GPIOE_PPMODE
$9
Push-Pull Mode Register
0 x 3FFF
GPIOE_RAWDATA
$A
Raw Data Input Register
—
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