參數(shù)資料
型號(hào)： MC68334GCEH20
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 2/76頁(yè)
文件大小： 0K
描述： IC MICROPROCESSOR 20MHZ 132-PQFP
標(biāo)準(zhǔn)包裝： 36
系列： M683xx
核心處理器： CPU32
芯體尺寸： 32-位
速度： 20MHz
連通性： EBI/EMI，UART/USART
輸入/輸出數(shù)： 47
程序存儲(chǔ)器類型： ROMless
RAM 容量： 1K x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x8/10b
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 132-BQFP 緩沖式
包裝： 托盤
MC68334
10
MC68334TS/D
2.5 Signal Function
Table 6 MCU Signal Function
Mnemonic
Signal Name
Function
ADDR[23:0]
Address Bus
24-bit address bus used by CPU32
AN[6:0]
ADC Analog Input
Inputs to ADC multiplexer
AS
Address Strobe
Indicates that a valid address is on the address bus
AVEC
Autovector
Requests an automatic vector during interrupt acknowledge
BERR
Bus Error
Indicates that a bus error has occurred
BG
Bus Grant
Indicates that the MCU has relinquished the bus
BGACK
Bus Grant Acknowledge Indicates that an external device has assumed bus mastership
BKPT
Breakpoint
Signals a hardware breakpoint to the CPU
BR
Bus Request
Indicates that an external device requires bus mastership
CLKOUT
System Clockout
System clock output
CS[10:0]
Chip Selects
Select external devices at programmed addresses
CSBOOT
Boot Chip Select
Chip select for external boot start-up ROM
DATA[15:0]
Data Bus
16-bit data bus
DS
Data Strobe
During a read cycle, indicates when it is possible for an external
device to place data on the data bus. During a write cycle,
indicates that valid data is on the data bus.
DSACK[1:0]
Data and Size
Acknowledge
Provide asynchronous data transfers and dynamic bus sizing
DSI, DSO, DSCLK
Development Serial In,
Out, Clock
Serial I/O and clock for background debugging mode
ECLK
E-Clock
External M6800 bus clock output
EXTAL, XTAL
Crystal Oscillator
Connections for clock synthesizer circuit reference;
a crystal or an external oscillator can be used
FC[2:0]
Function Codes
Identify processor state and current address space
FREEZE
Freeze
Indicates that the CPU has entered background mode
HALT
Halt
Suspend external bus activity
IFETCH
Instruction Fetch
Identifies bus cycles in which operand is loaded into pipeline
IPIPE
Instruction Pipeline
Indicates instruction pipeline activity
IRQ[7:1]
Interrupt Request Level Provide prioritized interrupts to the CPU
MODCLK
Clock Mode Select
Selects the source and type of system clock
PADA[6:0]
Port ADA
ADC digital input port signals
PC[6:0]
Port C
SIM digital output port signals
PE[7:0]
Port E
SIM digital I/O port signals
PF[7:0]
Port F
SIM digital I/O port signals
QUOT
Quotient Out
Provides the quotient bit of the polynomial divider
RESET
Reset
System reset
RMC
Read-Modify-Write Cycle Indicates an indivisible read-modify-write instruction
R/W
Read/Write
Indicates the direction of data transfer on the bus
SIZ[1:0]
Size
Indicates the number of bytes to be transferred during a bus cycle
TPUCH[15:0]
TPU I/O Channels
Bidirectional TPU channels
TSC
Three-State Control
Places all output drivers in a high-impedance state
T2CLK
TCR2 Clock
TPU clock input
VRH, VRL
ADC Reference Voltage Provide precise reference for A/D conversion
XFC
External Filter Capacitor Connection for external phase-locked loop filter capacitor
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PDF描述
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