參數(shù)資料
型號: MC68334GCFC16
廠商: Freescale Semiconductor
文件頁數(shù): 55/76頁
文件大小: 0K
描述: IC MCU 16MHZ 1K RAM 132-PQFP
標準包裝: 36
系列: M683xx
核心處理器: CPU32
芯體尺寸: 32-位
速度: 16MHz
連通性: EBI/EMI,UART/USART
輸入/輸出數(shù): 47
程序存儲器類型: ROMless
RAM 容量: 1K x 8
電壓 - 電源 (Vcc/Vdd): 3 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器: A/D 8x8/10b
振蕩器型: 外部
工作溫度: -40°C ~ 85°C
封裝/外殼: 132-BQFP 緩沖式
包裝: 托盤
MC68334
MC68334TS/D REV. 1
59
Figure 13 Prescaler Control 2
STF — Stop Flag
0 = TPU operating
1 = TPU stopped (STOP bit has been asserted)
SUPV — Supervisor Data Space
0 = Assignable registers are unrestricted (FC2 is ignored)
1 = Assignable registers are restricted (FC2 is decoded)
PSCK — Prescaler Clock
0 = System clock/32 is input to TCR1 prescaler
1 = System clock/4 is input to TCR1 prescaler
IARB — Interrupt Arbitration Identification Number
The IARB field is used to arbitrate between simultaneous interrupt requests of the same priority. Each
module that can generate interrupt requests must be assigned a unique, nonzero IARB field value. Re-
fer to 3.8 Interrupts for more information.
CIRL — Channel Interrupt Request Level
The interrupt request level for all channels is specified by this 3-bit encoded field. Level seven for this
field indicates a nonmaskable interrupt; level zero indicates that all channel interrupts are disabled.
CIBV — Channel Interrupt Base Vector
The TPU is assigned 16 unique interrupt vector numbers, one vector number for each channel. The
CIBV field specifies the most significant nibble of all 16 TPU channel interrupt vector numbers. The low-
er nibble of the TPU interrupt vector number is determined by the channel number on which the interrupt
occurs.
TICR
— TPU Interrupt Configuration Register
$YFFE08
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
NOT USED
CIRL
CIBV
NOT USED
RESET:
0
TPU PRE BLOCK 2
SYNCHRONIZER
INT CLK
÷ 8
0 – A
1 – B
T2CG CONTROL BIT
A
B
TCR2
015
TCR2
PRESCALER
00
÷ 1
01
÷ 2
10
÷ 4
11
÷ 8
T2CLK
PIN
DIGITAL
FILTER
PROGRAMMABLE
DIGITAL
FILTER
0 – A
1 – B
T2C FILTER BIT
A
B
MUX
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PDF描述
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參數(shù)描述
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