參數(shù)資料
型號(hào)： MC68F375BGMVR33R
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 355/616頁(yè)
文件大?。?/td> 0K
描述： IC MPU 32BIT 33MHZ 217-PBGA
標(biāo)準(zhǔn)包裝： 500
系列： M683xx
處理器類型： M683xx 32-位
速度： 33MHz
電壓： 5V
安裝類型： 表面貼裝
封裝/外殼： 217-BBGA
供應(yīng)商設(shè)備封裝： 217-PBGA（23x23）
包裝： 帶卷 (TR)
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MC68F375
MASK ROM MODULE
MOTOROLA
REFERENCE MANUAL
Rev. 25 June 03
12-4
ROMMCR — ROM Module Configuration Register
0xYF F820
MSB
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
LSB
0
STOP
RESERVED
BOOT LOCK EMUL
ASPC[1:0],2
2. Indicates bits protected by LOCK and STOP.
WAIT[1:0}3
3. Indicates bits protected by LOCK only.
RESERVED
RESET:
0
U1
NOTES:
1. The default state of this bit is defined by customer specified options.
U1
0
U1
0
Table 12-2 ROMMCR Bit Settings
Bit(s)
Name
Description
15
STOP
Inverted state of D[14]. If STOP is set to a 1 by the inverted D[14] during master reset, the array
may be re-enabled by clearing STOP after master reset. If bootstrap mode is enabled, (BOOT
= 0), clearing STOP will not cause the ROM to enter bootstrap mode. The STOP bit must be set
in order to change the value of the array base address (ROMBAH, ROMBAL), the state of the
EMUL control bit, or the value of the ASPC field in ROMMCR. Clearing the STOP bit also deac-
tivates emulation mode, but does not disable it.
0 = The ROM module is in normal mode of operation.
1 = Causes the ROM module to enter STOP mode.
14:13
—
Reserved
12
BOOT
Bootstrap enable. At mask programming time, the ROM module may be specified to function as
a bootstrap ROM after RESET or only as a ROM array at a specified base address. The BOOT
bit is forced to its default reset state by master reset. The default reset state of the BOOT bit is
specified by the user at mask programming time and is programmed on the same mask layer as
the contents of the array.
0 = ROM module will respond to the bootstrap addresses after RESET.
1 = ROM module will not respond to the bootstrap addresses after RESET.
11
LOCK
Lock registers. Once the LOCK bit is set, via an IMB3 write, it cannot be cleared again until after
a master reset. If the default reset state is 1, all registers and bits protected by the LOCK
bit can never be changed. The LOCK bit is forced to its default reset state by master reset. The
default reset state of the LOCK bit is specified by the user at mask programming time and is pro-
grammed on the same mask layer as the contents of the array. To ensure that inadvertent re-
configuration of the ROM cannot occur, the user’s initialization program should always write this
bit to a one to invoke the write lock mechanism, if it’s default reset state is 0.
0 = Write lock is disabled.
1 = Write-locked registers are protected.
10
EMUL
Emulation mode. Emulation mode allows the ROM array to be emulated externally, with access
controlled by the ROM module BIU. Bootstrap operation is not affected by emulation mode, nor
is it emulated. Emulation mode may be entered by writing EMUL to a 1. The STOP bit in the
ROMMCR must be a 1 in order to change the state of the EMUL bit by writing to it via the IMB3.
In emulation mode the ROM will not respond to an array address with IAACKB, however, it will
respond to control register accesses. Instead of responding with IAACKB to array addresses, it
will assert the ICSMB line on the IMB3, allowing the device’s external bus interface to assert an
external chip select and run a special external bus cycle which is terminated by the ROM assert-
ing IDTACKB on the IMB3. The ROM will assert IDTACKB after the proper number of WAIT
states, as specified in the WAIT field of the ROMMCR register. The ROM module will not drive
the IMB3 data lines however. Data must be provided by an external device at the proper time.
0 = The ROM module is in normal mode of operation.
1 = Causes the ROM module to enter emulation mode.
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述
AMC50DTES CONN EDGECARD 100POS .100 EYELET
MC68EN360ZP33L IC MPU QUICC 32BIT 33MHZ 357PBGA
HMC50DTEF CONN EDGECARD 100POS .100 EYELET
MC68EN360ZP25LR2 IC MPU QUICC 32BIT 25MHZ 357PBGA
AMC36DTEF CONN EDGECARD 72POS .100 EYELET
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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MC68F375MZP33R2 功能描述:IC MPU 32BIT 33MHZ 217-PBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標(biāo)準(zhǔn)包裝:1 系列:MPC85xx 處理器類型:32-位 MPC85xx PowerQUICC III 特點(diǎn):- 速度:1.2GHz 電壓:1.1V 安裝類型:表面貼裝 封裝/外殼:783-BBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:783-FCPBGA（29x29） 包裝:托盤
MC68H(R)C08JK1 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HCMOS Microcontroller Unit
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MC68H(R)C08JL3 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HCMOS Microcontroller Unit
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