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參數(shù)資料
| 型號： | MC68HC08GP16AMBE |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 8.2 MHz, MICROCONTROLLER, PDIP42 |
| 封裝： | LEAD FREE, PLASTIC, SDIP-42 |
| 文件頁數(shù)： | 3/258頁 |
| 文件大小： | 1855K |
| 代理商： | MC68HC08GP16AMBE |
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Low-Voltage Inhibit (LVI)
MC68HC08GP32A MC68HC08GP16A Data Sheet, Rev. 1.0
100
Freescale Semiconductor
Figure 10-1. LVI Module Block Diagram
10.3.3 Voltage Hysteresis Protection
Once the LVI has triggered (by having VDD fall below VTRIPF), the LVI will maintain a reset condition until
VDD rises above the rising trip point voltage, VTRIPR. This prevents a condition in which the MCU is
continually entering and exiting reset if VDD is approximately equal to VTRIPF. VTRIPR is greater than
VTRIPF by the hysteresis voltage, VHYS.
10.3.4 LVI Trip Selection
The LVI5OR3 bit in the mask option register selects whether the LVI is configured for 5-V or 3-V
protection.
NOTE
The microcontroller is guaranteed to operate at a minimum supply voltage.
The trip point (VTRIPF [5 V] or VTRIPF [3 V]) may be lower than this. (See
Chapter 20 Electrical Specifications for the actual trip point voltages.)
Addr.
Register Name
Bit 7
654321
Bit 0
$FE0C
LVI Status Register
(LVISR)
Read:
LVIOUT
0000000
Write:
Reset:
00000000
= Unimplemented
Figure 10-2. LVI I/O Register Summary
LOW VDD
DETECTOR
LVIPWRD
STOP INSTRUCTION
LVISTOP
LVI RESET
LVIOUT
VDD > LVITrip = 0
VDD ≤ LVITrip = 1
FROM MOR
VDD
FROM MOR
LVIRSTD
LVI5OR3
FROM MOR
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PDF描述 |
|---|---|
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| MC68HC08GP16AVFB | 8-BIT, MROM, 8.2 MHz, MICROCONTROLLER, PQFP44 |
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參數(shù)描述 |
|---|---|
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