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參數(shù)資料
| 型號(hào)： | MC68HC11KMNPEVS |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 13/268頁 |
| 文件大?。?/td> | 1875K |
| 代理商： | MC68HC11KMNPEVS |
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MC68HC11P2 — Rev 1.0
Technical Data
List of Figures
Technical Data — MC68HC11P2
List of Figures
Figure
Title
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MC68HC11P2/MC68HC711P2 block diagram. . . . . . . . . . . . .19
84-pin PLCC/CERQUAD pinout . . . . . . . . . . . . . . . . . . . . . . . .22
External reset circuitry . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .24
Oscillator connections. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .25
PLL circuit. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .27
RAM stand-by connections. . . . . . . . . . . . . . . . . . . . . . . . . . . .33
MC68HC11P2 memory map. . . . . . . . . . . . . . . . . . . . . . . . . . .44
RAM and register overlap. . . . . . . . . . . . . . . . . . . . . . . . . . . . .57
SCI baud rate generator circuit diagram. . . . . . . . . . . . . . . . . .88
SCI1 block diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .90
Interrupt source resolution within SCI. . . . . . . . . . . . . . . . . . .103
MI BUS timing. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .111
Biphase coding and error detection . . . . . . . . . . . . . . . . . . . .113
MI BUS block diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .115
A typical interface between the MC68HC11P2 and the MI BUS
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .116
SPI block diagram. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .127
SPI transfer format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .128
Timer clock divider chains . . . . . . . . . . . . . . . . . . . . . . . . . . .140
Capture/compare block diagram. . . . . . . . . . . . . . . . . . . . . . .141
Pulse accumulator block diagram. . . . . . . . . . . . . . . . . . . . . .159
PWM timer block diagram. . . . . . . . . . . . . . . . . . . . . . . . . . . .164
PWM duty cycle . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .170
A/D converter block diagram . . . . . . . . . . . . . . . . . . . . . . . . .174
Electrical model of an A/D input pin (in sample mode). . . . . .175
A/D conversion sequence. . . . . . . . . . . . . . . . . . . . . . . . . . . .177
Processing flow out of reset (1 of 2). . . . . . . . . . . . . . . . . . . .206
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Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
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PDF描述 |
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