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參數(shù)資料
| 型號： | MC68HCP11A1CP2 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | HCMOS Single-Chip Microcontroller |
| 中文描述： | 8-BIT, 2 MHz, MICROCONTROLLER, PDIP48 |
| 封裝： | DIP-48 |
| 文件頁數(shù)： | 107/158頁 |
| 文件大?。?/td> | 776K |
| 代理商： | MC68HCP11A1CP2 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁當(dāng)前第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁
MC68HC11A8
TECHNICAL DATA
CPU, ADDRESSING MODES, AND INSTRUCTION SET
MOTOROLA
10-9
10
LDS (opr)
Load Stack Pointer
M:M + 1
→
SP
IMM
DIR
EXT
IND,X
IND,Y
IMM
DIR
EXT
IND,X
IND,Y
IMM
DIR
EXT
IND,X
IND,Y
EXT
IND,X
IND,Y
A INH
B INH
8E
9E
BE
AE
18 AE
CE
DE
jj kk
dd
hh ll
ff
ff
jj kk
dd
hh ll
ff
ff
jj kk
dd
hh ll
ff
ff
hh ll
ff
ff
3
2
3
2
3
3
2
3
2
3
4
3
4
3
3
3
2
3
1
1
3
4
5
5
6
3
4
5
5
6
4
5
6
6
6
6
6
7
2
2
3-2
4-3
5-4
6-6
7-6
3-2
4-3
5-4
6-6
7-6
3-4
4-5
5-6
6-7
7-6
5-8
6-3
3-7
2-1
2-1
- - - -
¤ ¤
0 -
LDX (opr)
Load Index Register X
M:M + 1
→
IX
FE
EE
CD EE
18 CE
18 DE
18 FE
1A EE
18 EE
- - - -
¤ ¤
0 -
LDY (opr)
Load Index Register Y
M:M + 1
→
IY
- - - -
¤ ¤
0 -
LSL (opr)
LSLA
LSLB
Logical Shift Left
78
68
18 68
48
58
- - - -
¤ ¤ ¤ ¤
LSLD
Logical Shift Left Double
INH
05
1
3
2-2
- - - -
¤ ¤ ¤ ¤
LSR (opr)
LSRA
LSRB
Logical Shift Right
EXT
IND,X
IND,Y
A INH
B INH
74
64
18 64
44
54
hh ll
ff
ff
3
2
3
1
1
6
6
7
2
2
5-8
6-3
7-3
2-1
2-1
- - - -
¤ ¤ ¤ ¤
LSRD
Logical Shift Right Double
INH
04
1
3
2-2
- - - - 0
¤ ¤ ¤
MUL
Multiply 8 by 8
AxB
→
D
INH
3D
1
10
2-13
- - - - - - -
¤
NEG (opr)
2’s Complement Memory Byte 0 – M
→
M
EXT
IND,X
IND,Y
A INH
B INH
INH
A IMM
A DIR
A EXT
A IND,X
A IND,Y
B IMM
B DIR
B EXT
B IND,X
B IND,Y
A INH
B INH
INH
INH
A INH
B INH
INH
INH
EXT
IND,X
IND,Y
A INH
B INH
70
60
18 60
hh ll
ff
ff
3
2
3
1
1
1
2
2
3
2
3
2
2
3
2
3
1
1
1
2
1
1
1
2
3
2
3
1
1
6
6
7
2
2
2
2
3
4
4
5
2
3
4
4
5
3
3
4
5
4
4
5
6
6
6
7
2
2
5-8
6-3
7-3
2-1
2-1
2-1
3-1
4-1
5-2
6-2
7-2
3-1
4-1
5-2
6-2
7-2
2-6
2-6
2-7
2-8
2-9
2-9
2-10
2-11
5-8
6-3
7-3
2-1
2-1
- - - -
¤ ¤ ¤ ¤
NEGA
NEGB
NOP
ORAA (opr) OR Accumulator A (Inclusive) A + M
→
A
2’s Complement A
2’s Complement B
No Operation
0 – A
→
A
0 – B
→
B
No Operation
40
50
01
8A
9A
BA
AA
- - - -
¤ ¤ ¤ ¤
- - - -
¤ ¤ ¤ ¤
- - - - - - - -
- - - -
¤ ¤
0 -
18 AA
CA
DA
ii
dd
hh ll
ff
ff
ii
dd
hh ll
ff
ff
ORAB (opr) OR Accumulator B (Inclusive) B + M
→
B
FA
EA
18 EA
- - - -
¤ ¤
0 -
PSHA
PSHB
PSHX
PSHY
PULA
PULB
PULX
PULY
ROL (opr)
Push A onto Stack
Push B onto Stack
Push X onto Stack (Lo First)
Push Y onto Stack (Lo First)
Pull A from Stack
Pull B from Stack
Pull X from Stack (Hi First)
Pull Y from Stack (Hi First)
Rotate Left
A
→
Stk, SP = SP–1
B
→
Stk, SP = SP–1
IX
→
Stk, SP = SP–2
IY
→
Stk, SP = SP–2
SP = SP + 1, A
←
Stk
SP = SP + 1, B
←
Stk
SP = SP + 2, IX
←
Stk
SP = SP + 2, IY
←
Stk
36
37
3C
- - - - - - - -
- - - - - - - -
- - - - - - - -
- - - - - - - -
- - - - - - - -
- - - - - - - -
- - - - - - - -
- - - - - - - -
- - - -
¤ ¤ ¤ ¤
18 3C
32
33
38
18 38
79
69
18 69
49
59
hh ll
ff
ff
ROLA
ROLB
Table 10-1 MC68HC11A8 Instructions, Addressing Modes, and Execution Times
(Sheet 4 of 6)
Source
Form(s)
Operation
Boolean Expression
Addressing
Mode for
Operand
Machine Coding
(Hexadecimal)
Opcode
B
C
Cycle
by
Cycle*
Condition Codes
Operand(s)
S X H I N Z V C
*Cycle-by-cycle number provides a reference to Tables 10-2 through 10-8 which detail cycle-by-cycle operation.
Example: Table 10-1 Cycle-by-Cycle column reference number 2-4 equals Table 10-2 line item 2-4.
C
b0
b7
0
C
b0
b15
0
C
b0
b7
0
C
b0
b15
0
C
b0
b7
C
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68HCP11A1CP3 | HCMOS Single-Chip Microcontroller |
| MC68HCP11A1MFN2 | HCMOS Single-Chip Microcontroller |
| MC68HCP11A1MP2 | HCMOS Single-Chip Microcontroller |
| MC68HCP11A1VFN2 | HCMOS Single-Chip Microcontroller |
| MC68HCP11A1VP2 | HCMOS Single-Chip Microcontroller |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC68HCP11A1FN | 制造商:MOTORALA 功能描述: |
| MC68HCP11E0CP2 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| MC68HCP11E0FN | 功能描述:MICROCONTROLLER MCU 8ADC 3MHC RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:HC11 標(biāo)準(zhǔn)包裝:250 系列:56F8xxx 核心處理器:56800E 芯體尺寸:16-位 速度:60MHz 連通性:CAN，SCI，SPI 外圍設(shè)備:POR，PWM，溫度傳感器，WDT 輸入/輸出數(shù):21 程序存儲器容量:40KB（20K x 16） 程序存儲器類型:閃存 EEPROM 大小:- RAM 容量:6K x 16 電壓 - 電源 (Vcc/Vdd):2.25 V ~ 3.6 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 6x12b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 125°C 封裝/外殼:48-LQFP 包裝:托盤 配用:MC56F8323EVME-ND - BOARD EVALUATION MC56F8323 |
| MC68HCP11E0FNE | 功能描述:8位微控制器 -MCU 8B MCU 512RAM COP A/D RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
| MC68HCP11E1CFNE2 | 功能描述:8位微控制器 -MCU 8B MCU 512 BYTES RAM RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
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