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參數(shù)資料
| 型號： | MC705X32VFUE |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 108/232頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 8BIT 32K FLASH 64-QFP |
| 標(biāo)準(zhǔn)包裝： | 84 |
| 系列： | HC05 |
| 核心處理器： | HC05 |
| 芯體尺寸： | 8-位 |
| 速度： | 4MHz |
| 連通性： | CAN，SCI |
| 外圍設(shè)備： | POR，WDT |
| 輸入/輸出數(shù)： | 24 |
| 程序存儲器容量： | 32KB（32K x 8） |
| 程序存儲器類型： | OTP |
| EEPROM 大?。?/td> | 256 x 8 |
| RAM 容量： | 528 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 4.5 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x8b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 105°C |
| 封裝/外殼： | 64-QFP |
| 包裝： | 托盤 |
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MC68HC05X16
Rev. 1
MC68HC705X32
15
B.7
Mask option register (MOR)
WOI — Wired-OR interrupt enable
1 (set)
–
Wired-OR interrupts are enabled, provided the WOIE bit in the
EPROM/EEPROM/ECLK control register is set.
0 (clear) –
Wired-OR interrupts are disabled, irrespective of the WOIE bit in the
EPROM/EEPROM/ECLK control register.
The WOI bit can be used to enable the wired-OR interrupt (WOI) on all port B pins that have been
programmed as inputs. WOI is activated if the WOI bit is set and if the WOIE bit in the OPTR
register is also set.
DIV2, DIV8 — Clock divide ratio selection
The DIV2 and DIV8 bits are used to select the CPU clock divide ratio (see Table B-4). Note that a
divide-by-two clock ratio is forced in bootstrap mode, regardless of the DIV2 and DIV8 values.
RTIM — Reset time
This bit can modify the time tPORL, where the RESET pin is kept low after a power-on reset.
1 (set)
–
tPORL = 16 cycles.
0 (clear) –
tPORL = 4064 cycles.
RWAT — Watchdog after reset
This bit can modify the status of the watchdog counter after reset.
1 (set)
–
The watchdog will be active immediately following power-on or
external reset (except in bootstrap mode).
0 (clear) –
The watchdog system will be disabled after power-on or external reset.
(1) This register is implemented in EPROM; therefore reset has no effect on the individual bits. However, please read the important note on page B-1.
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
Mask option register (MOR)(1)
$7FDE
WOI
DIV2
DIV8
RTIM
RWAT WWAT PBPD
PCPD Not affected
Table B-4 Clock divide ratio selection
DIV2
DIV8
Clock divide ratio
11
2
10
4
01
8
00
10
194
F
re
e
sc
a
le
S
e
m
ic
o
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d
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r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
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Freescale Semiconductor, Inc.
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