參數(shù)資料
型號: MC705X32VFUE
廠商: Freescale Semiconductor
文件頁數(shù): 76/232頁
文件大小: 0K
描述: IC MCU 8BIT 32K FLASH 64-QFP
標(biāo)準(zhǔn)包裝: 84
系列: HC05
核心處理器: HC05
芯體尺寸: 8-位
速度: 4MHz
連通性: CAN,SCI
外圍設(shè)備: POR,WDT
輸入/輸出數(shù): 24
程序存儲器容量: 32KB(32K x 8)
程序存儲器類型: OTP
EEPROM 大?。?/td> 256 x 8
RAM 容量: 528 x 8
電壓 - 電源 (Vcc/Vdd): 4.5 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器: A/D 8x8b
振蕩器型: 內(nèi)部
工作溫度: -40°C ~ 105°C
封裝/外殼: 64-QFP
包裝: 托盤
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MC68HC05X16
12-5
ELECTRICAL SPECIFICATIONS
12
12.4
Control timing
(1) For bus frequencies less than 2 MHz, the internal RC oscillator should be used when
programming the EEPROM.
(2) Since a 2-bit prescaler in the timer must count four external cycles (tcyc), this is the limiting
factor in determining the timer resolution.
(3) The minimum period tTLTL should not be less than the number of cycle times it takes to execute
the capture interrupt service routine plus 24 tcyc.
(4) The minimum period tILIL should not be less than the number of cycle times it takes to execute
the interrupt service routine plus 21 tcyc.
(5) At a temperature of 85
°C.
(6) Refer to Reliability Monitor Report (currrent quarterly issue) for current failure rate information.
Table 12-4 Control timing
(VDD = 5.0 Vdc ± 10%, VSS = 0 Vdc, TA = –40°C to +125°C)
Characteristic
Symbol
Min
Max
Unit
Frequency of operation
Oscillator frequency
MCAN module clock frequency
MCU bus frequency
fOSC
fCAN
fMCU
0
22
11
2.2
MHz
Cycle time (see Figure 10-1)tCYC
455
ns
Crystal oscillator start-up time (see Figure 10-1)tOXOV
100
ms
Stop recovery start-up time (crystal oscillator)
tILCH
100
ms
A/D converter stabilization time
tADON
500
s
External RESET input pulse width
tRL
1.5
tCYC
Power-on RESET output pulse width (mask option)
4064 cycle
16 cycle
tPORL
4064
16
tCYC
Watchdog RESET output pulse width
tDOGL
1.5
tCYC
Watchdog time-out
tDOG
6144
7168
tCYC
EEPROM byte erase time
tERA
10
ms
EEPROM byte program time(1)
tPROG
10
ms
Timer (see Figure 12-1)
Resolution(2)
Input capture pulse width
Input capture pulse period
tRESL
tTH, tTL
tTLTL
4
125
(3)
tCYC
ns
tCYC
Interrupt pulse width (edge-triggered)
tILIH
125
ns
Interrupt pulse period
tILIL
(4)
—tCYC
OSC1 pulse width
tOH, tOL
90
ns
Write/erase endurance(5)(6)
10000
cycles
Data retention(5)(6)
10
years
Figure 12-1 Timer relationship
External
signal
(TCAP1,
TCAP2)
tTLTL
tTH
tTL
165
F
re
e
sc
a
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S
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I
Freescale Semiconductor, Inc.
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