參數(shù)資料
型號(hào): MC705X32VFUE
廠商: Freescale Semiconductor
文件頁數(shù): 36/232頁
文件大?。?/td> 0K
描述: IC MCU 8BIT 32K FLASH 64-QFP
標(biāo)準(zhǔn)包裝: 84
系列: HC05
核心處理器: HC05
芯體尺寸: 8-位
速度: 4MHz
連通性: CAN,SCI
外圍設(shè)備: POR,WDT
輸入/輸出數(shù): 24
程序存儲(chǔ)器容量: 32KB(32K x 8)
程序存儲(chǔ)器類型: OTP
EEPROM 大小: 256 x 8
RAM 容量: 528 x 8
電壓 - 電源 (Vcc/Vdd): 4.5 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器: A/D 8x8b
振蕩器型: 內(nèi)部
工作溫度: -40°C ~ 105°C
封裝/外殼: 64-QFP
包裝: 托盤
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MC68HC05X16
Rev. 1
ANALOG TO DIGITAL CONVERTER
9
The A/D reference input (AN0–AN7) is applied to a precision internal D/A converter. Control logic
drives this D/A converter and the analog output is successively compared with the analog input
sampled at the beginning of the conversion. The conversion is monotonic with no missing codes.
The result of each successive comparison is stored in the SAR and, when the conversion is
complete, the contents of the SAR are transferred to the read-only result data register ($08), and
the conversion complete ag, COCO, is set in the A/D status/control register ($09).
Warning: Any write to the A/D status/control register will abort the current conversion, reset the
conversion complete ag and start a new conversion on the selected channel.
At power-on or external reset, both the ADRC and ADON bits are cleared; thus the A/D is disabled.
Figure 9-1 A/D converter block diagram
AN0
VRH
(VRH+VRL)/2
VRL
Analog
MUX
A/D result register (ADDATA) $08
8-bit capacitive DAC
with sample and hold
VRH
VRL
Result
A/D status/control register (ADSTAT)$09
(Channel
assignment)
COCO
ADRC
ADON
0
CH3
CH2
CH1
CH0
AN1
AN2
AN3
AN4
AN5
AN6
AN7
Successive approximation
register (SAR) and control
128
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Freescale Semiconductor, Inc.
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