參數(shù)資料
型號(hào)： MC908JL16CDWE
廠商： Freescale Semiconductor
文件頁數(shù)： 212/230頁
文件大?。?/td> 0K
描述： IC MCU 16K FLASH 8MHZ 28-SOIC
標(biāo)準(zhǔn)包裝： 26
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 8MHz
連通性： I²C，SCI
外圍設(shè)備： LED，LVD，POR，PWM
輸入/輸出數(shù)： 23
程序存儲(chǔ)器容量： 16KB（16K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 512 x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 12x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 28-SOIC（0.295"，7.50mm 寬）
包裝： 管件
產(chǎn)品目錄頁面： 724 (CN2011-ZH PDF)
配用： DEMO908JL16E-ND - BOARD DEMO FOR MC908JL16
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Timer Interface Module (TIM)
MC68HC908JL16 Data Sheet, Rev. 1.1
82
Freescale Semiconductor
ELSxB and ELSxA — Edge/Level Select Bits
When channel x is an input capture channel, these read/write bits control the active edge-sensing logic
on channel x.
When channel x is an output compare channel, ELSxB and ELSxA control the channel x output
behavior when an output compare occurs.
When ELSxB and ELSxA are both clear, channel x is not connected to an I/O port, and pin TCHx is
available as a general-purpose I/O pin. Table 6-3 shows how ELSxB and ELSxA work. Reset clears
the ELSxB and ELSxA bits.
NOTE
Before enabling a TIM channel register for input capture operation, make
sure that the TCHx pin is stable for at least two bus clocks.
TOVx — Toggle On Overflow Bit
When channel x is an output compare channel, this read/write bit controls the behavior of the channel
x output when the TIM counter overflows. When channel x is an input capture channel, TOVx has no
effect.
Reset clears the TOVx bit.
1 = Channel x pin toggles on TIM counter overflow
0 = Channel x pin does not toggle on TIM counter overflow
NOTE
When TOVx is set, a TIM counter overflow takes precedence over a
channel x output compare if both occur at the same time.
CHxMAX — Channel x Maximum Duty Cycle Bit
When the TOVx bit is at logic 1, setting the CHxMAX bit forces the duty cycle of buffered and
unbuffered PWM signals to 100%. As Figure 6-11 shows, the CHxMAX bit takes effect in the cycle
after it is set or cleared. The output stays at the 100% duty cycle level until the cycle after CHxMAX is
cleared.
Table 6-3. Mode, Edge, and Level Selection
MSxB:MSxA
ELSxB:ELSxA
Mode
Configuration
X0
00
Output preset
Pin under port control; initial output level high
X1
00
Pin under port control; initial output level low
00
01
Input capture
Capture on rising edge only
00
10
Capture on falling edge only
00
11
Capture on rising or falling edge
01
Output compare or PWM
Toggle output on compare
01
10
Clear output on compare
01
11
Set output on compare
1X
01
Buffered output
compare or
buffered PWM
Toggle output on compare
1X
10
Clear output on compare
1X
11
Set output on compare
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