參數(shù)資料
型號： MC908JL16CDWE
廠商： Freescale Semiconductor
文件頁數(shù)： 59/230頁
文件大小： 0K
描述： IC MCU 16K FLASH 8MHZ 28-SOIC
標準包裝： 26
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 8MHz
連通性： I²C，SCI
外圍設備： LED，LVD，POR，PWM
輸入/輸出數(shù)： 23
程序存儲器容量： 16KB（16K x 8）
程序存儲器類型： 閃存
RAM 容量： 512 x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
數(shù)據(jù)轉換器： A/D 12x10b
振蕩器型： 內部
工作溫度： -40°C ~ 85°C
封裝/外殼： 28-SOIC（0.295"，7.50mm 寬）
包裝： 管件
產品目錄頁面： 724 (CN2011-ZH PDF)
配用： DEMO908JL16E-ND - BOARD DEMO FOR MC908JL16
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MC68HC908JL16 Data Sheet, Rev. 1.1
Freescale Semiconductor
151
Chapter 11
External Interrupt (IRQ)
11.1 Introduction
The external interrupt (IRQ) module provides a maskable interrupt input.
11.2 Features
Features of the IRQ module include the following:
A dedicated external interrupt pin (IRQ)
IRQ interrupt control bits
Hysteresis buffer
Programmable edge-only or edge and level interrupt sensitivity
Automatic interrupt acknowledge
Selectable internal pullup resistor
11.3 Functional Description
A logic zero applied to the external interrupt pin can latch a CPU interrupt request. Figure 11-1 shows the
structure of the IRQ module.
Interrupt signals on the IRQ pin are latched into the IRQ latch. An interrupt latch remains set until one of
the following actions occurs:
Vector fetch — A vector fetch automatically generates an interrupt acknowledge signal that clears
the IRQ latch.
Software clear — Software can clear the interrupt latch by writing to the acknowledge bit in the
interrupt status and control register (INTSCR). Writing a logic one to the ACK bit clears the IRQ
latch.
Reset — A reset automatically clears the interrupt latch.
The external interrupt pin is falling-edge-triggered and is software-configurable to be either falling-edge
or falling-edge and low-level-triggered. The MODE bit in the INTSCR controls the triggering sensitivity of
the IRQ pin.
When the interrupt pin is edge-triggered only, the CPU interrupt request remains set until a vector fetch,
software clear, or reset occurs.
When the interrupt pin is both falling-edge and low-level-triggered, the CPU interrupt request remains set
until both of the following occur:
Vector fetch or software clear
Return of the interrupt pin to logic one
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PDF描述
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參數(shù)描述
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