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參數(shù)資料
| 型號： | MC908QL2C |
| 廠商： | Motorola, Inc. |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 191/222頁 |
| 文件大小： | 2861K |
| 代理商： | MC908QL2C |
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Break Module (BRK)
MC68HC908QL4 MC68HC908QL3 MC68HC908QL2 Data Sheet, Rev. 4
Freescale Semiconductor
191
16.2.2.3 Break Auxiliary Register
The break auxiliary register (BRKAR) contains a bit that enables software to disable the COP while the
MCU is in a state of break interrupt with monitor mode.
BDCOP — Break Disable COP Bit
This read/write bit disables the COP during a break interrupt. Reset clears the BDCOP bit.
1 = COP disabled during break interrupt
0 = COP enabled during break interrupt
16.2.2.4 Break Status Register
The break status register (BSR) contains a flag to indicate that a break caused an exit from wait mode.
This register is only used in emulation mode.
SBSW — SIM Break Stop/Wait
SBSW can be read within the break state SWI routine. The user can modify the return address on the
stack by subtracting one from it.
1 = Wait mode was exited by break interrupt
0 = Wait mode was not exited by break interrupt
16.2.2.5 Break Flag Control Register
The break control register (BFCR) contains a bit that enables software to clear status bits while the MCU
is in a break state.
BCFE — Break Clear Flag Enable Bit
This read/write bit enables software to clear status bits by accessing status registers while the MCU is
in a break state. To clear status bits during the break state, the BCFE bit must be set.
1 = Status bits clearable during break
0 = Status bits not clearable during break
Bit 7
0
6
0
5
0
4
0
3
0
2
0
1
0
Bit 0
Read:
Write:
Reset:
BDCOP
0
0
0
0
0
0
0
0
= Unimplemented
Figure 16-6. Break Auxiliary Register (BRKAR)
Bit 7
6
5
4
3
2
1
Bit 0
Read:
Write:
Reset:
R
R
R
R
R
R
SBSW
Note
(1)
0
R
R
= Reserved
Figure 16-7. Break Status Register (BSR)
1. Writing a 0 clears SBSW.
Bit 7
6
5
4
3
2
1
Bit 0
Read:
Write:
Reset:
BCFE
R
R
R
R
R
R
R
0
R
= Reserved
Figure 16-8. Break Flag Control Register (BFCR)
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PDF描述 |
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參數(shù)描述 |
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