Table 24. NFC Target Timing Parameters
參數(shù)資料
型號： MC9328MX21SVMR2
廠商： Freescale Semiconductor
文件頁數(shù)： 30/88頁
文件大?。?/td> 0K
描述： IC MPU I.MX21S 289-MAPBGA
標準包裝： 1,000
系列： i.MX21
核心處理器： ARM9
芯體尺寸： 32-位
速度： 266MHz
連通性： 1 線，EBI/EMI，I²C，IrDA，MMC，智能卡，SPI，SSI，UART/USART，USB OTG
外圍設(shè)備： DMA，I²S，LCD，POR，PWM，WDT
輸入/輸出數(shù)： 192
程序存儲器類型： ROMless
電壓 - 電源 (Vcc/Vdd)： 1.45 V ~ 3.3 V
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 289-LFBGA
包裝： 帶卷 (TR)
MC9328MX21S Technical Data, Rev. 1.3
36
Freescale Semiconductor
Specifications
Table 24. NFC Target Timing Parameters1,2
1. High is defined as 80% of signal value and low is defined as 20% of signal value. All timings are listed according to this NFC
clock frequency (multiples of NFC clock period) except NF16, which is not NFC clock related.
2. The read data is generated by the NAND Flash device and sampled with the internal NFC clock.
ID
Parameter
Symbol
Relationship to NFC
Clock Period
(T)
NFC Clock
22.17 MHz
T = 45 ns
NFC Clock
33.25 MHz
T = 30 ns
Unit
Min
Max
Min
Max
Min
Max
NF1
NFCLE Setup Time
tCLS
T
–
45
–
30
–
ns
NF2
NFCLE Hold Time
tCLH
T
–
45
–
30
–
ns
NF3
NFCE Setup Time
tCS
T
–
45
–
30
–
ns
NF4
NFCE Hold Time
tCH
T
–
45
–
30
–
ns
NF5
NF_WP Pulse Width
tWP
T
–
45
–
30
–
ns
NF6
NFALE Setup Time
tALS
T
–
45
–
30
–
ns
NF7
NFALE Hold Time
tALH
T
–
45
–
30
–
ns
NF8
Data Setup Time
tDS
T
–
45
–
30
–
ns
NF9
Data Hold Time
tDH
T
–
45
–
30
–
ns
NF10
Write Cycle Time
tWC
2T
–
90
–
60
–
ns
NF11
NFWE Hold Time
tWH
T
–
45
–
30
–
ns
NF12
Ready to NFRE Low
tRR
4T
–
180
–
120
–
ns
NF13
NFRE Pulse Width
tRP
1.5T
–
67.5
–
45
–
ns
NF14
READ Cycle Time
tRC
2T
–
90
–
60
–
ns
NF15
NFRE High Hold Time
tREH
0.5T
–
22.5
–
15
–
ns
NF16
Data Setup on READ
tDSR
15
–
15
–
15
–
ns
NF17
Data Hold on READ
tDHR
0
–
0
–
0
–
ns
Because
of
an
order
from
the
United
States
International
Trade
Commission,
BGA-packaged
product
lines
and
part
numbers
indicated
here
currently
are
not
available
from
Freescale
for
import
or
sale
in
the
United
States
prior
to
September
2010:
i.MX21
Product
Family
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