參數(shù)資料
型號(hào)： MC9328MX21SVMR2
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 33/88頁(yè)
文件大?。?/td> 0K
描述： IC MPU I.MX21S 289-MAPBGA
標(biāo)準(zhǔn)包裝： 1,000
系列： i.MX21
核心處理器： ARM9
芯體尺寸： 32-位
速度： 266MHz
連通性： 1 線，EBI/EMI，I²C，IrDA，MMC，智能卡，SPI，SSI，UART/USART，USB OTG
外圍設(shè)備： DMA，I²S，LCD，POR，PWM，WDT
輸入/輸出數(shù)： 192
程序存儲(chǔ)器類(lèi)型： ROMless
電壓 - 電源 (Vcc/Vdd)： 1.45 V ~ 3.3 V
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 289-LFBGA
包裝： 帶卷 (TR)
Specifications
MC9328MX21S Technical Data, Rev. 1.3
Freescale Semiconductor
39
Figure 31. SDRAM Write Cycle Timing Diagram
4S
Address setup time
3.67
–
2
–
ns
4H
Address hold time
2.95
–
2
–
ns
5
SDRAM access time (CL = 3)
–
5.4
–
5.4
ns
5
SDRAM access time (CL = 2)
–
6.0
–
6.0
ns
5
SDRAM access time (CL = 1)
–
ns
6
Data out hold time
2
–
2
–ns
7
Data out high-impedance time (CL = 3)
–
tHZ
1
–tHZ
1
ns
7
Data out high-impedance time (CL = 2)
–
tHZ
1
–tHZ
1
ns
7
Data out high-impedance time (CL = 1)
–
ns
8
Active to read/write command period (RC = 1)
tRCD
2
–tRCD
2
–ns
1. tHZ = SDRAM data out high-impedance time, external SDRAM memory device dependent parameter.
2. tRCD = SDRAM clock cycle time. The tRCD setting can be found in the i.MX21S reference manual.
Table 26. SDRAM Read Cycle Timing Parameter (Continued)
Ref
No.
Parameter
1.8 V
± 0.1 V
3.0 V
± 0.3 V
Unit
Minimum
Maximum
Minimum
Maximum
SDCLK
CS
CAS
WE
RAS
ADDR
DQ
DQM
/ BA
ROW/BA
3
4
6
1
COL/BA
DATA
2
5
7
8
9
Because
of
an
order
from
the
United
States
International
Trade
Commission,
BGA-packaged
product
lines
and
part
numbers
indicated
here
currently
are
not
available
from
Freescale
for
import
or
sale
in
the
United
States
prior
to
September
2010:
i.MX21
Product
Family
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