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參數(shù)資料
| 型號： | MC9328MX21VMR2 |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 43/100頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU I.MX21 266MHZ 289-MAPBGA |
| 標(biāo)準(zhǔn)包裝： | 1,000 |
| 系列： | i.MX21 |
| 核心處理器： | ARM9 |
| 芯體尺寸： | 32-位 |
| 速度： | 266MHz |
| 連通性： | 1 線，EBI/EMI，I²C，IrDA，MMC，智能卡，SPI，SSI，UART/USART，USB OTG |
| 外圍設(shè)備： | DMA，I²S，LCD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 192 |
| 程序存儲器類型： | ROMless |
| 電壓 - 電源 (Vcc/Vdd)： | 1.45 V ~ 3.3 V |
| 振蕩器型： | 外部 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 289-LFBGA |
| 包裝： | 帶卷 (TR) |
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Specifications
MC9328MX21 Technical Data, Rev. 3.4
Freescale Semiconductor
47
3.15
SDRAM Memory Controller
The following figures (Figure 38 through Figure 41) and their associated tables specify the timings related
to the SDRAMC module in the i.MX21.
Figure 38. SDRAM Read Cycle Timing Diagram
Table 31. SDRAM Read Cycle Timing Parameter
Ref
No.
Parameter
1.8 V
± 0.1 V
3.0 V
± 0.3 V
Unit
Minimum
Maximum
Minimum
Maximum
1
SDRAM clock high-level width
3.00
–
3
–
ns
2
SDRAM clock low-level width
3.00
–
3
–
ns
3
SDRAM clock cycle time
7.5
–
7.5
–
ns
3S
CS, RAS, CAS, WE, DQM setup time
4.78
–
3
–
ns
3H
CS, RAS, CAS, WE, DQM hold time
3.03
–
2
–
ns
SDCLK
WE
ADDR
DQ
DQM
ROW/BA
COL/BA
3S
3H
3S
3H
3S
3
S
3H
4S 4H
5
3S
3
2
1
8
Data
7
6
CS
CAS
RAS
Note:
CKE is high during the read/write cycle.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC9328MX21DVMR2 | IC MCU I.MX21 266MHZ 289-MAPBGA |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC9328MXL | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MX Family of applications processors |
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| MC9328MXL_06 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MX Family of applications processors |
| MC9328MXLCVF15 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:i.MX Integrated Portable System Processor |
| MC9328MXLCVH15 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:i.MX Integrated Portable System Processor |
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